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一種移位寄存器、其驅(qū)動(dòng)方法、柵極驅(qū)動(dòng)電路及顯示裝置的制造方法

文檔序號(hào):8261215閱讀:509來源:國知局
一種移位寄存器、其驅(qū)動(dòng)方法、柵極驅(qū)動(dòng)電路及顯示裝置的制造方法
【技術(shù)領(lǐng)域】
[0001]本發(fā)明涉及顯示技術(shù)領(lǐng)域,尤其涉及一種移位寄存器、其驅(qū)動(dòng)方法、柵極驅(qū)動(dòng)電路及顯示裝置。
【背景技術(shù)】
[0002]在薄膜晶體管顯示器中,通常通過柵極驅(qū)動(dòng)電路向像素區(qū)域的各個(gè)薄膜晶體管(TFT, Thin Film Transistor)的柵極提供柵極驅(qū)動(dòng)信號(hào)。柵極驅(qū)動(dòng)電路可以通過陣列工藝形成在液晶顯示器的陣列基板上,即陣列基板行驅(qū)動(dòng)(Gate Driver on Array, GOA)工藝,這種集成工藝不僅節(jié)省了成本,而且可以做到液晶面板(Panel)兩邊對(duì)稱的美觀設(shè)計(jì),同時(shí),也省去了柵極集成電路(IC,Integrated Circuit)的綁定(Bonding)區(qū)域以及扇出(Fan-out)的布線空間,從而可以實(shí)現(xiàn)窄邊框的設(shè)計(jì)。
[0003]現(xiàn)有的GOA電路,如圖1a所示,由多個(gè)移位寄存器組成,各個(gè)移位寄存器用于向與該移位寄存器的信號(hào)輸出端相連的柵線提供柵極掃描信號(hào),并向與其相鄰的上一個(gè)移位寄存器的復(fù)位信號(hào)端輸入復(fù)位信號(hào),向與其相鄰的下一個(gè)移位寄存器的信號(hào)輸入端輸入觸發(fā)信號(hào)。如圖1b所示,為現(xiàn)有的一個(gè)移位寄存器的結(jié)構(gòu)示意圖,使用4個(gè)薄膜晶體管M1-M4和一個(gè)電容Cl可以實(shí)現(xiàn)最基本的移位寄存器功能,具體工作原理如下:在觸發(fā)信號(hào)Input端輸入高電位信號(hào)時(shí),第一薄膜晶體管Ml導(dǎo)通對(duì)上拉節(jié)點(diǎn)即PU節(jié)點(diǎn)充電,此時(shí)第三薄膜晶體管M3導(dǎo)通;當(dāng)時(shí)鐘信號(hào)CLK端輸入高電位信號(hào)時(shí),導(dǎo)通的第三薄膜晶體管M3使信號(hào)輸出端Output輸出時(shí)鐘信號(hào)CLK端提供的高電位信號(hào),同時(shí)由于電容Cl的自舉作用將I3U節(jié)點(diǎn)進(jìn)一步拉高;之后,復(fù)位信號(hào)Reset端輸入高電位信號(hào)時(shí),第二薄膜晶體管M2和第四薄膜晶體管M4導(dǎo)通,對(duì)PU節(jié)點(diǎn)和信號(hào)輸出端Output放電。
[0004]眾所周知,在GOA電路中,同一時(shí)刻,僅有當(dāng)級(jí)移位寄存器的信號(hào)輸出端輸出高電位信號(hào),其它級(jí)移位寄存器的信號(hào)輸出端均需要輸出低電位信號(hào)。但是在現(xiàn)有的移位寄存器中,例如圖1b所示的移位寄存器,僅在復(fù)位信號(hào)Reset端輸入高電位信號(hào)時(shí)才對(duì)節(jié)點(diǎn)和信號(hào)輸出端Output放電,而復(fù)位信號(hào)Reset端輸入高電位信號(hào)的延續(xù)時(shí)間僅是下一級(jí)移位寄存器的信號(hào)輸出端Output輸出高電位信號(hào)的時(shí)間,那么在當(dāng)級(jí)移位寄存器的信號(hào)輸出端Output需要輸出低電位信號(hào)的其它時(shí)間內(nèi),由于M3的漏極接時(shí)鐘信號(hào)CLK端,因此M3的漏極和柵極之間存在電容,從而使M3的柵極的電位會(huì)受到交流時(shí)鐘信號(hào)的影響,長時(shí)間的工作導(dǎo)致M3柵極的電位持續(xù)升高,使M3處于導(dǎo)通狀態(tài),那么只要當(dāng)時(shí)鐘信號(hào)CLK為高電位信號(hào)的時(shí)候,移位寄存器的信號(hào)輸出端Output就會(huì)輸出高電位信號(hào),從而導(dǎo)致移位寄存器發(fā)生錯(cuò)誤輸出。

【發(fā)明內(nèi)容】

[0005]有鑒于此,本發(fā)明實(shí)施例提供一種移位寄存器、其驅(qū)動(dòng)方法、柵極驅(qū)動(dòng)電路及顯示裝置,用于解決現(xiàn)有的移位寄存器存在的容易發(fā)生輸出錯(cuò)誤的問題。
[0006]因此,本發(fā)明實(shí)施例提供了一種移位寄存器,包括:輸入模塊、輸出模塊和復(fù)位模塊和放電模塊;其中,
[0007]所述輸入模塊,用于響應(yīng)于觸發(fā)信號(hào),在所述觸發(fā)信號(hào)的控制下,控制所述第一節(jié)點(diǎn)的電位為第一電位,第二節(jié)點(diǎn)的電位為第二電位,并對(duì)所述輸出模塊進(jìn)行充電;所述第一節(jié)點(diǎn)位于連接所述輸入模塊、所述輸出模塊、所述復(fù)位模塊以及所述放電模塊的導(dǎo)線上;所述第二節(jié)點(diǎn)位于連接所述復(fù)位模塊和所述放電模塊的導(dǎo)線上;
[0008]所述輸出模塊,用于在所述第一節(jié)點(diǎn)的電位為第一電位時(shí),將時(shí)鐘信號(hào)提供給信號(hào)輸出端;
[0009]所述復(fù)位模塊,用于響應(yīng)于復(fù)位信號(hào),在所述復(fù)位信號(hào)的控制下,控制所述第一節(jié)點(diǎn)的電位為第二電位,所述第二節(jié)點(diǎn)的電位為第一電位,并對(duì)所述放電模塊進(jìn)行充電,以及將參考信號(hào)提供給信號(hào)輸出端;
[0010]放電模塊,用于在所述復(fù)位信號(hào)的電位為第一電位之后至所述觸發(fā)信號(hào)的電位為第一電位之前,控制所述第二節(jié)點(diǎn)的電位為第一電位,并且在所述第二節(jié)點(diǎn)的電位為第一電位時(shí)將參考信號(hào)提供給所述第一節(jié)點(diǎn)和所述信號(hào)輸出端;
[0011]所述觸發(fā)信號(hào)的有效脈沖信號(hào)為高電位信號(hào),所述第一電位為高電位,所述第二電位為低電位,所述參考信號(hào)為低電位直流信號(hào);所述觸發(fā)信號(hào)的有效脈沖信號(hào)為低電位信號(hào),所述第一電位為低電位,所述第二電位為高電位,所述參考信號(hào)為高電位直流信號(hào)。
[0012]在一種可能的實(shí)施方式中,在本發(fā)明實(shí)施例提供的上述移位寄存器中,
[0013]所述輸入模塊,具體包括:第一開關(guān)晶體管和第二開關(guān)晶體管;其中,
[0014]所述第一開關(guān)晶體管,其柵極與源極均用于接收所述觸發(fā)信號(hào),漏極與所述第一節(jié)點(diǎn)相連;
[0015]所述第二開關(guān)晶體管,其柵極用于接收所述觸發(fā)信號(hào),源極用于接收所述參考信號(hào),漏極與所述第二節(jié)點(diǎn)相連。
[0016]在一種可能的實(shí)施方式中,在本發(fā)明實(shí)施例提供的上述移位寄存器中,
[0017]所述輸出模塊,具體包括:第三開關(guān)晶體管和第一電容;其中,
[0018]所述第三開關(guān)晶體管,其柵極與所述第一節(jié)點(diǎn)相連,源極用于接收所述時(shí)鐘信號(hào),漏極與所述信號(hào)輸出端相連;
[0019]所述第一電容連接于所述第三開關(guān)晶體管的柵極與漏極之間。
[0020]在一種可能的實(shí)施方式中,在本發(fā)明實(shí)施例提供的上述移位寄存器中,
[0021]所述復(fù)位模塊,具體包括:第四開關(guān)晶體管、第五開關(guān)晶體管和第六開關(guān)晶體管;其中,
[0022]所述第四開關(guān)晶體管,其柵極用于接收所述復(fù)位信號(hào),源極用于接收所述參考信號(hào),其漏極與所述第一節(jié)點(diǎn)相連;
[0023]所述第五開關(guān)晶體管,其柵極用于接收所述復(fù)位信號(hào),源極用于接收所述參考信號(hào),其漏極與所述信號(hào)輸出端相連;
[0024]所述第六開關(guān)晶體管,其柵極和漏極均用于接收所述復(fù)位信號(hào),其漏極與所述第二節(jié)點(diǎn)相連。
[0025]在一種可能的實(shí)施方式中,在本發(fā)明實(shí)施例提供的上述移位寄存器中,
[0026]所述放電模塊,具體包括:第七開關(guān)晶體管、第八開關(guān)晶體管和第二電容;其中,
[0027]所述第七開關(guān)晶體管,其柵極與所述第二節(jié)點(diǎn)相連,源極用于接收所述參考信號(hào),漏極與所述信號(hào)輸出端相連;
[0028]所述第八開關(guān)晶體管,其柵極與所述第二節(jié)點(diǎn)相連,源極用于接收所述參考信號(hào),漏極與所述第一節(jié)點(diǎn)相連;
[0029]所述第二電容連接于所述第七開關(guān)晶體管的柵極與源極之間。
[0030]在一種可能的實(shí)施方式中,在本發(fā)明實(shí)施例提供的上述移位寄存器中,
[0031]當(dāng)所述觸發(fā)信號(hào)的有效脈沖信號(hào)為高電位信號(hào),所有開關(guān)晶體管均為N型晶體管;
[0032]當(dāng)所述觸發(fā)信號(hào)的有效脈沖信號(hào)為低電位信號(hào),所有開關(guān)晶體管均為P型晶體管。
[0033]相應(yīng)地,本發(fā)明實(shí)施例還提供了一種上述任一種移位寄存器的驅(qū)動(dòng)方法,包括:
[0034]在輸入階段,所述輸出模塊響應(yīng)于觸發(fā)信號(hào),在所述觸發(fā)信號(hào)的控制下,控制所述第一節(jié)點(diǎn)的電位為第一電位,第二節(jié)點(diǎn)的電位為第二電位,并對(duì)所述輸出模塊進(jìn)行充電;所述輸出模塊將時(shí)鐘信號(hào)提供給信號(hào)輸出端;
[0035]在輸出階段,所述輸出模塊保持所述第一節(jié)點(diǎn)的電位為第一電位,并將所述時(shí)鐘信號(hào)提供給信號(hào)輸出端;
[0036]在復(fù)位階段,所述復(fù)位模塊響應(yīng)于復(fù)位信號(hào),在所述復(fù)位信號(hào)的控制下,控制所述第一節(jié)點(diǎn)的電位為第二電位,所述第二節(jié)點(diǎn)的電位為第一電位,并對(duì)所述放電模塊進(jìn)行充電,以及將參考信號(hào)提供給信號(hào)輸出端;所述放電模塊將參考信號(hào)提供給所述第一節(jié)點(diǎn)和所述信號(hào)輸出端;
[0037]在放電階段,所述放電模塊控制第二節(jié)點(diǎn)的電位為第一電位,并將參考信號(hào)提供給所述第一節(jié)點(diǎn)和所述信號(hào)輸出端。
[0038]相應(yīng)地,本發(fā)明實(shí)施例還提供了一種柵極驅(qū)動(dòng)電路,包括級(jí)聯(lián)的多個(gè)本發(fā)明實(shí)施例提供的上述任一種移位寄存器;其中,
[0039]除第一級(jí)移位寄存器之外,其余每一級(jí)移位寄存器的信號(hào)輸出端分別向與其相鄰的上一級(jí)移位寄存器輸入復(fù)位信號(hào);
[0040]除最后一級(jí)移位寄存器之外,其余每一級(jí)移位寄存器的信號(hào)輸出端分別向與其相鄰的下一級(jí)移位寄存器輸入觸發(fā)信號(hào);
[0041]所述第一級(jí)移位寄存器所接收的觸發(fā)信號(hào)由幀起始信號(hào)端輸入;
[0042]所述柵極驅(qū)動(dòng)電路順序地輸出各級(jí)移位寄存器的信號(hào)輸出端輸出的柵極驅(qū)動(dòng)信號(hào)。
[0043]相應(yīng)地,本發(fā)明實(shí)施例還提供了一種顯示裝置,包括本發(fā)明實(shí)施例提供的上述任一種柵極驅(qū)動(dòng)電路。
[0044]本發(fā)明實(shí)施例提供的上述移位寄存器、其驅(qū)動(dòng)方法、柵極驅(qū)動(dòng)電路及顯示裝置,移位寄存器包括:輸入模塊、輸出模塊和復(fù)位模塊和放電模塊;由于放電模塊可以在復(fù)位信號(hào)的電位為第一電位之后至觸發(fā)信號(hào)的電位為第一電位之前,控制第二節(jié)點(diǎn)的電位為第一電位,并且在第二節(jié)點(diǎn)的電位為第一電位時(shí)將參考信號(hào)提供給第一節(jié)點(diǎn)和信號(hào)輸出端;從而可以保證該移位寄存器在復(fù)位信號(hào)的電位為第一電位之后至觸發(fā)信號(hào)的電位為第一電位之前的時(shí)間段內(nèi),對(duì)第一節(jié)點(diǎn)和信號(hào)輸出端進(jìn)行有效的放電,進(jìn)而保證了移位寄存器輸出的準(zhǔn)確性。
【附圖說明】
[0045]圖1a為現(xiàn)有的GOA電路的結(jié)構(gòu)示意圖;
[0046]圖1b為現(xiàn)有的移位寄存器的結(jié)構(gòu)示意圖;
[0047]圖2為本發(fā)明實(shí)施例提供的移位寄存器的結(jié)構(gòu)示意圖;
[0048]圖3a為本發(fā)明實(shí)施例提供的移位寄存器的具體結(jié)構(gòu)示意圖之一;
[0049]圖3b為本發(fā)明實(shí)施例提供的移位寄存器的具體結(jié)構(gòu)示意圖之二 ;
[0050]圖4a為圖3a所不的移位寄存器的電路時(shí)序不意圖;
[0051]圖4b為圖3b所不的移位寄存器的電路時(shí)序不意圖;
[0052]圖5為本發(fā)明實(shí)施例
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