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一種電源控制裝置及方法_2

文檔序號:9199931閱讀:來源:國知局
第一輸入電壓。如此,可根據(jù)基準電路的啟動情況,使第一 LDO工作在不同的工作模式;根據(jù)電壓檢測電路提供的使能信號使第二 LDO確定自身最低消耗的工作模式,達到低功耗的目的。
【附圖說明】
[0032]圖1為本發(fā)明實施例一提供的電源控制裝置的結(jié)構(gòu)示意圖;
[0033]圖2為本發(fā)明實施例一提供的第一 LDO的結(jié)構(gòu)示意圖;
[0034]圖3為本發(fā)明實施例一提供的第二 LDO的結(jié)構(gòu)示意圖;
[0035]圖4為本發(fā)明實施例二提供的用于電源控制的方法示意圖。
【具體實施方式】
[0036]在本發(fā)明的實施例中,第一電源選擇電路在USBIN電壓和ACIN電壓中選擇電壓較高的一路電壓作為第一輸出電壓;第一 LDO通過自啟動電路啟動,并對所述第一輸出電壓進行降壓作為第二輸出電壓;第二電源選擇電路在第二輸出電壓和VBAT中選擇電壓較高的一路電壓作為第三輸出電壓;第二 LDO將第三輸出電壓作為第一輸入電壓提供給基準電路,所述基準電路根據(jù)所述第一輸入電壓輸出基準電壓,所述第二 LDO收到基準電壓后,關(guān)閉自啟動電路;電壓檢測電路根據(jù)基準電壓確定USBIN電壓或ACIN電壓達到閾值電壓時,為第二LDO提供使能信號;所述第二LDO收到使能信號后,自身向基準電路提供第一輸入電壓。
[0037]下面通過附圖及具體實施例對本發(fā)明的技術(shù)方案做進一步的詳細說明。
[0038]實施例一
[0039]本發(fā)明實施例提供一種電源控制裝置,如圖1所示,該裝置包括:第一電源選擇電路11、第一 LD012、第二電源選擇電路13、第二 LD014、基準電路15、電壓檢測電路16 ;其中,
[0040]所述第一電源選擇電路11,用于在USBIN電壓和ACIN電壓中選擇電壓較高的一路電壓作為第一輸出電壓;
[0041]所述第一 LD012,用于對第一輸出電壓進行降壓;具體的,由于輸入電壓比較高,所以第一輸出電壓有可能達到1V以上,因此,第一 LD012將第一輸出電壓將到5V以下的電壓域內(nèi);并將降壓后的第一輸出電壓作為第二輸出電壓提供至所述第二電源選擇電路13 ;并且,在收到基準電壓之后,第一 LD012關(guān)閉自身的啟動電路;
[0042]這里,如圖2所示,所述第一 LD012包括:第一運算放大器0ΡΑ、第一 P溝道金屬氧化物半導體場效應(yīng)管(PM0S)、第二 PM0S、第三PM0S、第四PM0S、第一 N溝道金屬氧化物半導體場效應(yīng)管(NMOS)、第二 NM0S、第一電阻R1、第二電阻R2、第三電阻R3、電容Cl ;其中,
[0043]所述第一 OPA的第一輸入端接收第一輸出電壓,第二輸入端連接在所述第一電阻Rl與所述第二電阻R2相連的中間部分,所述第一 OPA的輸出端與所述第一 PMOS的柵極連接;所述第一 PMOS的漏極作為輸出,與第一電阻Rl的一端連接;所述第一 PMOS的源極與所述第二 PMOS的源極、所述第三PMOS的源極及所述第四PMOS的源極相連接;所述第二 PMOS的漏極與電容Cl的一端相連,所述電容Cl的另一端與所述第二 NOMS的柵極相連接,并連接在所述第二電阻R2與所述第三電阻R3相連的中間部分;所述第二 PMOS的柵極與所述第三PMOS的漏極及所述第一 NMOS的漏極相連接;所述第四PMOS的柵極、漏極與所述第二NMOS的漏極相連接;所述第二 NMOS的源極與所述第一 NMOS的源極相連接,并連接在所述第三電阻R3的另一端;所述第一電阻Rl與所述第二電阻R2和所述第三電阻R3串聯(lián)連接在所述第一 PMOS的漏極與所述第一 NMOS的源極之間;所述第一 NMOS的柵極接收偏置電流;
[0044]所述第一 0ΡΑ、第一 PM0S、第一電阻R1、第二電阻R2、第三電阻R3構(gòu)成第一級電路;所述第二 PM0S、第三PM0S、第四PMOS第一 NM0S、第二 NM0S、電容Cl構(gòu)成自啟動電路。
[0045]具體的,當輸入電壓剛剛接入時,基準電路15還未向第一 LD012提供基準信號,此時,A點為低電平,第一 OPA不工作,第一 NMOS處于導通狀態(tài),第二 NMOS處于截止狀態(tài),第一級電路中的電流將第二 PMOS的柵極拉低,此時,第二 PMOS導通,同時將B點拉高,B點與輸出連接作為第一 LD012的輸出;這時,第一 LD012完成自啟動;當?shù)谝?LD012接收到基準電壓,第一 OPA開始工作,輸出有電壓,那么A點也有電壓輸出,將第二 NMOS導通,因為第二NMOS的電流將大于第一 NMOS中的電流,所以,第三PMOS則將第二 PMOS的柵極拉高,使第二PMOS處于截止狀態(tài),從而關(guān)閉自啟動電路。
[0046]所述第二電源選擇電路13,用于在第二輸出電壓VBAT中選擇電壓較高的一路電壓作為第三輸出電壓;并將所述第三輸出電壓提供至第二 LD014,作為第二 LD014的輸入電壓;
[0047]所述第二 LD014,用于在未使能時,將第三輸出電壓作為第一輸入電壓提供給基準電路15,以使基準電路15啟動,為電壓檢測電路16、第一 LDO12、第二 LDO14提供基準電壓;并且,第二 LD014,還用于在使能時,自身向基準電路15提供第一輸入電壓;這里,所述基準電路15作為整個電路的基準電壓提供單元,會向電壓檢測電路16、第一 LD012、第二 LD014提供基準電壓。
[0048]所述電壓檢測電路16,根據(jù)基準電壓確定USBIN電壓或ACIN電壓達到閾值電壓時,為所述第二 LD014提供使能信號;還用于根據(jù)基準電壓確定USBIN電壓和ACIN電壓均沒有達到閾值電壓時,停止為第二 LD014提供使能信號;這里所述閾值電壓可以為電源芯片的啟動電壓,所述啟動電壓一般在2.8V-3.6V之間。
[0049]另外,所述第二 LD014在所述電壓檢測電路16停止提供使能信號后,繼續(xù)將第三輸出電壓作為第一輸入電壓提供給基準電路15,并將自身工作模式調(diào)整為電壓跟隨模式。
[0050]這里,如圖3所示,所述第二 LD014包括:第二 0ΡΑ、第五PM0S、第三NM0S、第四NM0S、其中,
[0051]所述第五PMOS的柵極與漏極、所述第二 OPA的輸出端、及所述第三NMOS的漏極相連接,所述第五PMOS的源極接收第三輸出電壓,所述第五PMOS的漏極作為輸出,與第四電阻R4的一端連接;所述第二 OPA的第三輸入端接收基準電壓,第四輸入端連接所述第四電阻R4和所述第五電阻R5相連的中間部分,第五輸入端接收第三輸出電壓,第六輸入端接收使能信號;所述第三NMOS的源極與所述第四NMOS的源極相連,并連接接地點,所述第三NMOS的柵極接收反使能信號;所述第四NMOS的柵極接收使能信號,漏極與所述第五電阻R5的一端相連;所述第四電阻R4與所述第五電阻R5串聯(lián)連接在第五PMOS的漏極和第四NMOS的漏極之間;
[0052]所述第二 0ΡΑ、第三NMOS構(gòu)成第一級電路;所述第五PM0S、第四電阻R4、第五電阻R5、第四NMOS構(gòu)成第二級電路。
[0053]具體的,當輸入電壓剛剛接入時,所述電壓檢測電路16根據(jù)基準電壓確定USBIN電壓和ACIN電壓均沒有達到閾值電壓時,則不會向第二 LD014提供使能信號;那么,第二LDO14關(guān)閉第二 0ΡΑ,關(guān)閉第二級電路中的從電源到接地點的通路,并將第五PMOS管的柵極與接地點相連接;這樣,就產(chǎn)生了一個直接從電源到輸出的通路,所以,第二 LD014的輸出電壓就跟隨了電源電壓,即第二 LD014的工作模式為電壓跟隨模式,以節(jié)省功耗;
[0054]當輸入電壓一直存在,電壓檢
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