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一種多jtag接口的電子設(shè)備升級系統(tǒng)的制作方法

文檔序號:6625786閱讀:602來源:國知局
一種多jtag接口的電子設(shè)備升級系統(tǒng)的制作方法
【專利摘要】本發(fā)明公開了一種多JTAG接口的電子設(shè)備升級系統(tǒng),該升級系統(tǒng)包括原設(shè)備的集成電路板和與集成電路板連接的JTAG接口,其特征是:在設(shè)備外還設(shè)置了與原設(shè)備連接的驅(qū)動電路模塊、選擇電路模塊、控制電路模塊、計(jì)算機(jī)和對外JTAG接口。計(jì)算機(jī)與控制電路連接,控制電路與選擇電路連接,選擇電路與驅(qū)動電路連接,驅(qū)動電路與原設(shè)備內(nèi)N個JTAG接口連接,原設(shè)備N個JTAG接口與對外的JTAG接口對接聯(lián)通。本發(fā)明可應(yīng)用于具有多個JTAG接口的設(shè)備或者系統(tǒng),在不需要打開設(shè)備機(jī)箱或者拔出電路板的情況下輕松實(shí)現(xiàn)設(shè)備程序下載或者升級功能。
【專利說明】-種多JTAG接口的電子設(shè)備升級系統(tǒng)

【技術(shù)領(lǐng)域】
[0001] 本發(fā)明涉及多JTAG接口的電子設(shè)備,具體就是一種多JTAG接口的電子設(shè)備升級 系統(tǒng)。

【背景技術(shù)】
[0002] 在現(xiàn)代電子設(shè)計(jì)中,越來越多的使用集成度高、容量大、處理能力強(qiáng)的可編程的數(shù) 字集成電路,這些集成電路的共同特點(diǎn)是需要對其進(jìn)行編程以達(dá)到使用的需求,同時,絕大 多數(shù)此類器件都使用JTAG接口進(jìn)行下載程序,比如FPGA、ARM、DSP器件等,JTAG接口的特 點(diǎn)是接口簡單、下載速度快、通用性好。
[0003] 對設(shè)備進(jìn)行升級一般有兩種方式:1、使用JTAG直接對設(shè)備進(jìn)行升級。2、使用CPU 模擬JTAG時序?qū)υO(shè)備進(jìn)行升級。
[0004] 使用JTAG直接對設(shè)備進(jìn)行升級時,可以給設(shè)計(jì)、開發(fā)等過程帶來了很多方便,并 且在設(shè)備使用時發(fā)生的異常現(xiàn)象可以很好的進(jìn)行跟蹤定位,但是在具有多JTAG接口的系 統(tǒng)平臺中,進(jìn)行設(shè)備的程序系統(tǒng)升級時具有以下缺點(diǎn):一、JTAG接口在設(shè)備或者系統(tǒng)的內(nèi) 部,在需要對器件程序進(jìn)行升級的時候需要打開機(jī)箱才能進(jìn)行下載程序操作;二、在結(jié)構(gòu)或 者空間的限制條件下無法實(shí)現(xiàn)現(xiàn)場升級,需要返廠進(jìn)行升級;三、需要對多個可編程的器件 進(jìn)行升級時,需要來回拔插下載線纜可靠性不好;四、不同的JTAG接口有不同的形式(比如 有十針、二十針的JTAG接口);五、對需要多次進(jìn)行升級的設(shè)備不適用。
[0005] 使用CPU模擬JTAG時序?qū)υO(shè)備進(jìn)行升級時,把需要升級的程序通過以太網(wǎng)傳輸 到CPU的緩存區(qū)中,然后由CPU模擬JTAG時序,將程序下載到設(shè)備中。該方式使用以太網(wǎng) 進(jìn)行升級,方便簡單。但是當(dāng)設(shè)備出現(xiàn)異常時,外部通用的調(diào)試監(jiān)控軟件(如FPGA的調(diào)試工 具CHIPSC0PE) -般需要使用JTAG接口訪問設(shè)備內(nèi)部的編程器件,而該方式不能提供外部 JTAG接口,因此不能很好地使用通用的調(diào)試監(jiān)控軟件對設(shè)備中的異?,F(xiàn)象進(jìn)行跟蹤定位。


【發(fā)明內(nèi)容】

[0006] 本發(fā)明的目的是為克服現(xiàn)有技術(shù)的不足,而提供一種多JTAG接口的電子設(shè)備升 級系統(tǒng),該系統(tǒng)升級操作簡便可靠。
[0007] 實(shí)現(xiàn)本發(fā)明的技術(shù)方案是: 一種多JTAG接口的電子設(shè)備升級系統(tǒng),包括原設(shè)備的集成電路板和與集成電路板連 接的JTAG接口,與現(xiàn)有技術(shù)不同的是,在設(shè)備外還設(shè)置了與原設(shè)備連接的驅(qū)動電路模塊、 選擇電路模塊、控制電路模塊、計(jì)算機(jī)和對外JTAG接口。計(jì)算機(jī)與控制電路連接,控制電路 與選擇電路連接,選擇電路與驅(qū)動電路連接,驅(qū)動電路與原設(shè)備內(nèi)N個JTAG接口連接,原設(shè) 備N個JTAG接口與對外的JTAG接口對接聯(lián)通。
[0008] 本升級系統(tǒng)的使用方法是:當(dāng)需要對某個JTAG接口對應(yīng)的電路板升級時首先由 計(jì)算機(jī)向控制電路模塊發(fā)送指令,告知其需要下載的目的JTAG接口,控制電路將指令傳遞 給選擇電路,選擇電路接收到控制信號以后,將需要下載的JTAG接口與對外的JTAG接口對 接連通,然后進(jìn)行程序下載操作,重復(fù)上述步驟,實(shí)現(xiàn)對不同電路板的JTAG進(jìn)行下載。
[0009] 本發(fā)明的有益效果:本發(fā)明的使用充分克服了使用JTAG接口系統(tǒng)升級的各種困 難,首先不需要打開設(shè)備的機(jī)箱進(jìn)行操作,節(jié)省時間方便簡單;其次不受空間地點(diǎn)的限制, 無論是在機(jī)架上還是在通信車等特殊環(huán)境下均可輕松操作;第三避免了在JTAG接口位置 不當(dāng)?shù)那闆r下無法實(shí)現(xiàn)升級的情況出現(xiàn);第四不需要來回拔插下載線纜穩(wěn)定可靠;第五在 系統(tǒng)調(diào)試時方便快捷的下載程序。

【專利附圖】

【附圖說明】
[0010] 圖1為本發(fā)明的系統(tǒng)框圖; 圖2為在線升級控制過程邏輯框圖; 圖3為SPI時序圖。

【具體實(shí)施方式】
[0011] 參照圖1,本發(fā)明主要由JTAG接口集成、選擇電路、控制電路、計(jì)算機(jī)、對外JTAG接 口幾部分組成,計(jì)算機(jī)與控制電路連接,控制電路與選擇電路連接,選擇電路與驅(qū)動電路連 接,驅(qū)動電路與原設(shè)備內(nèi)N個JTAG接口連接,原設(shè)備N個JTAG接口與對外的JTAG接口對 接聯(lián)通。
[0012] 參照圖2,本發(fā)明系統(tǒng)的升級過程是:控制盤的CPU接收計(jì)算機(jī)發(fā)送的網(wǎng)管命令 后,如果該命令為在線升級選擇命令,從網(wǎng)管命令中解析出在線升級實(shí)體編號(即指定需要 在線升級的FPGA或CPU的編號),然后通過SPI總線將需要在線升級的實(shí)體編號寫入FPGA 中的選擇控制寄存器中,F(xiàn)PGA中的JTAG選擇器根據(jù)選擇控制寄存器的值把外部JTAG接口 和需要升級實(shí)體的JTAG接口連通,然后對外部JTAG接口的操作就是對升級實(shí)體的JTAG接 口的操作。
[0013] 參照圖3, SPI通信的時序是:CPU與FPGA之間采用SPI接口進(jìn)行通信,CPU為主, FPGA為從。讀/寫操作始終由CPU發(fā)起。
【權(quán)利要求】
1. 一種多JTAG接口的電子設(shè)備升級系統(tǒng),包括原設(shè)備的集成電路板和與集成電路板 連接的JTAG接口,其特征是:在設(shè)備外還設(shè)置了與原設(shè)備連接的驅(qū)動電路模塊、選擇電路 模塊、控制電路模塊、計(jì)算機(jī)和對外JTAG接口;計(jì)算機(jī)與控制電路連接,控制電路與選擇電 路連接,選擇電路與驅(qū)動電路連接,驅(qū)動電路與原設(shè)備內(nèi)N個JTAG接口連接,原設(shè)備N個 JTAG接口與對外的JTAG接口對接聯(lián)通。
2. 根據(jù)權(quán)利要求1所述的一種多JTAG接口的電子設(shè)備升級系統(tǒng),其特征是:JTAG 口集 成部分將各個單元板上的不同類型的JTAG接口全部集中起來。
3. 根據(jù)權(quán)利要求1所述的一種多JTAG接口的電子設(shè)備升級系統(tǒng),其特征是:所述的選 擇電路主要功能是實(shí)現(xiàn)多JTAG接口的選擇,在JTAG接口全部匯聚到選擇電路以后,選擇電 路根據(jù)控制電路通過通信總線傳達(dá)的指令進(jìn)行分配和交叉,使需要升級的JTAG接口與對 外的JTAG接口進(jìn)行一一對接。
4. 根據(jù)權(quán)利要求1所述的一種多JTAG接口的電子設(shè)備升級系統(tǒng),其特征是:所述的控 制電路用過總線接口與選擇電路連接,通過串口或者以太網(wǎng)口與計(jì)算機(jī)進(jìn)行連接,實(shí)現(xiàn)計(jì) 算機(jī)的控制功能。
【文檔編號】G06F9/445GK104216747SQ201410445114
【公開日】2014年12月17日 申請日期:2014年9月3日 優(yōu)先權(quán)日:2014年9月3日
【發(fā)明者】曹志文, 龔華達(dá), 覃勇 申請人:中國電子科技集團(tuán)公司第三十四研究所, 桂林大為通信技術(shù)有限公司, 桂林信通科技有限公司
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