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一種處理器互聯(lián)資源調(diào)節(jié)方法、裝置、設(shè)備及介質(zhì)與流程

文檔序號:40430344發(fā)布日期:2024-12-24 15:04閱讀:來源:國知局

技術(shù)特征:

1.一種處理器互聯(lián)資源調(diào)節(jié)方法,所述方法應(yīng)用于處理器互聯(lián)資源調(diào)節(jié)系統(tǒng),其特征在于,所述系統(tǒng)包括第一處理器、第二處理器以及交換機(jī),所述第一處理器與所述第二處理器連接,所述第一處理器與第二處理器分別與所述交換機(jī)連接,所述方法包括:

2.根據(jù)權(quán)利要求1所述的處理器互聯(lián)資源調(diào)節(jié)方法,其特征在于,每個處理器包括若干個內(nèi)核,所述交換機(jī)包括若干個交換區(qū);所述處理器的各個內(nèi)核相互連通;所述第一處理器的第二內(nèi)核與所述第二處理器的第一內(nèi)核連接;所述第一處理器的第一內(nèi)核與所述第二處理器的第二內(nèi)核分別與所述交換機(jī)的第一交換區(qū)連接;所述第一處理器的第三內(nèi)核與所述第二處理器的第四內(nèi)核分別與所述交換機(jī)的第二交換區(qū)連接;所述第一處理器的第四內(nèi)核與所述第二處理器的第三內(nèi)核分別與所述交換機(jī)的第三交換區(qū)連接。

3.根據(jù)權(quán)利要求1所述的處理器互聯(lián)資源調(diào)節(jié)方法,其特征在于,所述處理器與交換機(jī)之間的通道信號狀態(tài)包括:高速并聯(lián)總線信號與高速串行總線信號;

4.根據(jù)權(quán)利要求3所述的處理器互聯(lián)資源調(diào)節(jié)方法,其特征在于,所述根據(jù)比對結(jié)果對所述處理器與交換機(jī)之間的通道信號狀態(tài)進(jìn)行調(diào)節(jié)以及根據(jù)處理器的第一性能數(shù)據(jù)更新計算,確定目標(biāo)硬件連接拓?fù)淠J?,包括?/p>

5.根據(jù)權(quán)利要求4所述的處理器互聯(lián)資源調(diào)節(jié)方法,其特征在于,所述根據(jù)比對結(jié)果對所述處理器與交換機(jī)之間的通道信號狀態(tài)進(jìn)行調(diào)節(jié)以及根據(jù)處理器的第一性能數(shù)據(jù)更新計算,確定目標(biāo)硬件連接拓?fù)淠J剑€包括:

6.根據(jù)權(quán)利要求2所述的處理器互聯(lián)資源調(diào)節(jié)方法,其特征在于,所述處理器的各個內(nèi)核相互連通,包括:所述第一處理器的第一內(nèi)核與所述第一處理器的第二內(nèi)核連接,所述第一處理器的第二內(nèi)核與所述第一處理器的第四內(nèi)核連接,所述第一處理器的第四內(nèi)核與所述第一處理器的第三內(nèi)核連接,所述第一處理器的第三內(nèi)核與所述第一處理器的第一內(nèi)核連接;所述第一處理器的第一內(nèi)核與所述第一處理器的第四內(nèi)核連接,所述第一處理器的第二內(nèi)核與所述第一處理器的第三內(nèi)核連接;

7.根據(jù)權(quán)利要求1所述的處理器互聯(lián)資源調(diào)節(jié)方法,其特征在于,所述方法,包括:

8.一種處理器互聯(lián)資源調(diào)節(jié)裝置,所述裝置應(yīng)用于處理器互聯(lián)資源調(diào)節(jié)系統(tǒng),所述系統(tǒng)包括第一處理器、第二處理器以及交換機(jī),所述第一處理器與所述第二處理器連接,所述第一處理器與第二處理器分別與所述交換機(jī)連接,其特征在于,所述裝置包括:

9.一種計算機(jī)設(shè)備,包括存儲器、處理器及存儲在存儲器上并可在處理器上運行的計算機(jī)程序,其特征在于,所述處理器執(zhí)行所述計算機(jī)程序時實現(xiàn)權(quán)利要求1至7中任一項所述處理器互聯(lián)資源調(diào)節(jié)方法的步驟。

10.一種計算機(jī)可讀存儲介質(zhì),其上存儲有計算機(jī)程序,其特征在于,所述計算機(jī)程序被處理器執(zhí)行時實現(xiàn)權(quán)利要求1至7中任一項所述的處理器互聯(lián)資源調(diào)節(jié)方法的步驟。


技術(shù)總結(jié)
本申請公開了一種處理器互聯(lián)資源調(diào)節(jié)方法、裝置、設(shè)備及介質(zhì),屬于電子技術(shù)領(lǐng)域,所述方法包括:獲取所述第一處理器與第二處理器之間互聯(lián)帶寬速率和第一互聯(lián)帶寬速率;獲取所述處理器的第一性能數(shù)據(jù);根據(jù)處理器互聯(lián)帶寬速率比對結(jié)果對所述處理器與交換機(jī)之間的通道信號狀態(tài)進(jìn)行調(diào)節(jié)以及根據(jù)處理器的第一性能數(shù)據(jù)更新計算,確定目標(biāo)硬件連接拓?fù)淠J?;通過所述目標(biāo)硬件連接拓?fù)淠J綄λ鎏幚砥骰ヂ?lián)資源進(jìn)行調(diào)節(jié)。本申請可以通過算法模型對處理器之間互聯(lián)信號資源進(jìn)行實時自適應(yīng)優(yōu)化,充分發(fā)揮處理器的性能。

技術(shù)研發(fā)人員:王培培
受保護(hù)的技術(shù)使用者:蘇州元腦智能科技有限公司
技術(shù)研發(fā)日:
技術(shù)公布日:2024/12/23
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