專利名稱:一種軌到軌使能信號的控制電路及電平轉(zhuǎn)換電路的制作方法
技術(shù)領(lǐng)域:
本實(shí)用新型涉及使能信號控制技木,尤其涉及ー種軌到軌(Rail-to-Rail)使能信號的控制電路及電平轉(zhuǎn)換電路。
背景技術(shù):
隨著不同工作電壓的數(shù)字集成電路(IC)地不斷涌現(xiàn),邏輯電平轉(zhuǎn)換的必要性更加突出,電平轉(zhuǎn)換方式也將隨邏輯電壓、數(shù)據(jù)總線形式、以及數(shù)據(jù)傳輸速率的不同而改變,所述數(shù)據(jù)總線形式可以是四線串行外設(shè)接ロ(SPI, Serial Peripheral Interface)、32位并行數(shù)據(jù)總線等等?,F(xiàn)在,雖然許多邏輯芯片都能實(shí)現(xiàn)軌到軌使能信號的控制,但當(dāng)電源掉電時,邏輯芯片將停止工作,軌到軌的使能信號輸出混亂,不能正確的輸出去使能信號。 如圖I所示的軌到軌使能信號的控制電路,其中,P溝道金屬氧化物半導(dǎo)體場效應(yīng)管(PMOS)Ml的源極和襯底連接電源pwrin,柵極接收輸入信號in,漏極連接N溝道金屬氧化物半導(dǎo)體場效應(yīng)管(NMOS) M2的漏極及PMOS M5的柵極;NM0S M2的源極和襯底連接電源地pwrn,柵極接收輸入信號in,漏極連接PMOS Ml的漏極及PMOS M5的柵極;PM0S M3的源極和襯底連接電源pwrin,柵極接收輸入信號in,漏極連接電阻Rl和NMOS M6的柵極;電阻Rl的一端連接PMOS M3的漏極和NMOS M6的柵極,另一端連接NMOS M4的漏極;NM0S M4的漏極連接電阻Rl,柵極連接PMOS M5的漏極,源極連接電源地pwrn和去使能信號提供節(jié)點(diǎn)nraiI,襯底連接電源地pwrn ;PM0S M5的源極和襯底連接電源pwrin,柵極連接PMOS Ml和NMOS M2的漏極,漏極連接電阻R2、NM0S M4的柵極、PMOS M7的漏極和PMOS M8的柵極;電阻R2的一端連接PMOS M5的漏極和NMOS M4的柵極,另一端連接NMOS M6的漏極;NM0SM6的漏極連接電阻R2,柵極連接PMOS M3的漏極,源極連接電源地pwrn和去使能信號提供節(jié)點(diǎn)nrail,襯底連接電源地pwrn ;PM0S M7的源極和襯底連接電源pwrin,柵極連接使能信號輸出節(jié)點(diǎn)eni_rr,漏極連接電阻R2、NMOS M4的柵極、PMOS M5的漏極和PMOS M8的柵極;PM0S M8的源極和襯底連接電源pwrin,柵極連接電阻R2、NMOS M4的柵極、NMOS M9的柵極、PMOS M5的漏極和PMOS M7的漏極,漏極連接使能信號輸出節(jié)點(diǎn)eni_rr ;NM0S M9的柵極連接源極連接電源地pwrn和去使能信號提供節(jié)點(diǎn)nrail,襯底連接電源地pwrn,柵極連接電阻R2、NMOS M4的柵極、PMOS M8的柵極、PMOS M5的漏極和PMOS M7的漏極,漏極連接使能信號輸出節(jié)點(diǎn)eni_rr ;在PMOS M8的柵極和NMOS M9的柵極還連接信號gate。在圖I中,在電源pwrin電壓VCC正常時,使能信號輸出節(jié)點(diǎn)eni_rr根據(jù)輸入信號in的高低電平輸出相應(yīng)的軌到軌的使能控制信號,如輸出電源pwrin電壓VCC、或去使能信號提供節(jié)點(diǎn)nrail的電壓Vnrail ;在電源掉電時,PM0SM3、PMOS M5的狀態(tài)均不穩(wěn)定,整個電路不能正常工作,使能信號輸出節(jié)點(diǎn)eni_rr將不能達(dá)到去使能信號提供節(jié)點(diǎn)nrail的電壓VnraiI,這樣,將不能向接受使能控制的設(shè)備提供準(zhǔn)確的使能控制信號。
實(shí)用新型內(nèi)容有鑒于此,為解決現(xiàn)有技術(shù)存在的提供使能控制信號的問題,本實(shí)用新型的主要目的在于提供一種軌到軌使能信號的控制電路及電平轉(zhuǎn)換電路。為達(dá)到上述目的,本實(shí)用新型的技術(shù)方案是這樣實(shí)現(xiàn)的本實(shí)用新型提供的ー種電平轉(zhuǎn)換電路,所述電平轉(zhuǎn)換電路包括根據(jù)第一信號的高低電平控制自身狀態(tài)為導(dǎo)通或截止的PMOS M10,所述PMOS MlO的漏極連接所述第一信號;所述第一信號在電源掉電時為低電平;在所述PMOS MlO導(dǎo)通時,保持使能信號輸出節(jié)點(diǎn)輸出使能信號;在所述PMOS MlO截止時,保持使能信號輸出節(jié)點(diǎn)輸出去使能信號的電阻R3。本實(shí)用新型提供的一種軌到軌使能信號的控制電路,該控制電路包括接收輸入信號的第一信號,按照第一信號的高低電平進(jìn)行使能控制;在電源掉電時輸出去使能信號的電平轉(zhuǎn)換電路。
本實(shí)用新型提供了一種軌到軌使能信號的控制電路及電平轉(zhuǎn)換電路,該控制電路包括電平轉(zhuǎn)換電路,配置為接收輸入信號的第一信號,按照第一信號的高低電平進(jìn)行使能控制;在電源掉電時輸出去使能信號;如此,在電源電壓正常時,電平轉(zhuǎn)換電路能根據(jù)第一信號的高低電平輸出軌到軌的使能信號或去使能信號;在電源掉電時,電平轉(zhuǎn)換電路能根據(jù)第一信號變?yōu)榈牡碗娖捷敵鋈ナ鼓苄盘?,從而為接受使能控制的設(shè)備提供準(zhǔn)確的使能控制信號。
圖I為現(xiàn)有技術(shù)中軌到軌使能信號的控制電路示意圖;圖2為本實(shí)用新型軌到軌使能信號的控制方法流程示意圖;圖3為本實(shí)用新型一種軌到軌使能信號的控制電路示意圖;圖4為本實(shí)用新型另ー種軌到軌使能信號的控制電路示意圖;圖5為本實(shí)用新型一對軌到軌使能信號的控制電路的仿真測試示意圖;圖6為本實(shí)用新型另ー對軌到軌使能信號的控制電路的仿真測試示意圖。
具體實(shí)施方式
本實(shí)用新型的基本思想是將控制電路的輸入信號的第一信號接入電平轉(zhuǎn)換電路;所述電平轉(zhuǎn)換電路按照第一信號的高低電平進(jìn)行使能控制;所述電平轉(zhuǎn)換電路在電源掉電時輸出去使能信號。具體的,在電源電壓正常時,電平轉(zhuǎn)換電路根據(jù)第一信號的高電平輸出使能信號,根據(jù)第一信號的低電平輸出去使能信號;在電源掉電時,電平轉(zhuǎn)換電路直接根據(jù)第一信號的低電平輸出去使能信號。下面通過附圖及具體實(shí)施例對本實(shí)用新型做進(jìn)ー步的詳細(xì)說明。本實(shí)用新型實(shí)現(xiàn)軌到軌使能信號的控制方法,如圖2所示,該方法包括以下步驟步驟101 :將控制電路的輸入信號的第一信號接入電平轉(zhuǎn)換電路;具體的,如圖3所示,通過緩沖器31獲得控制電路的輸入信號in的第一信號eni,將第一信號eni接入電平轉(zhuǎn)換電路32的PMOS MlO的漏極;所述緩沖器31包括兩個反相器opl和op2,其中,反相器op I的輸入端接收輸入信號in,輸出端連接反相器op2的輸入端;反相器op2的輸出端連接電平轉(zhuǎn)換電路32的PMOSMlO的漏極,所述反相器opl和反相器op2的電源引腳、接地引腳分別連接電源pwrin和電源地pwrn ;所述電平轉(zhuǎn)換電路32包括PMOS M10、電阻R3 ;其中,PMOS MlO的襯底連接電源pwrin,漏極連接輸入信號in的第一信號eni,源極連接使能信號輸出節(jié)點(diǎn)eni_rr和電阻R3,柵極連接電源地pwrn ;電阻R3在PMOS MlO的源極和去使能信號提供節(jié)點(diǎn)nrail之間;進(jìn)ー步的,本步驟還包括將輸入信號的第二信號接入電平轉(zhuǎn)換電路;具體的,如圖4所示,通過緩沖器31還獲得輸入信號in的第二信號eni_bar,將第ニ信號eni_bar接入電平轉(zhuǎn)換電路32的NMOS Mll的柵極;所述電平轉(zhuǎn)換電路32還包括用于限制電阻R3電流的NMOS M11,所述NMOS Mll設(shè)置在PMOS MlO與電阻R3之間,NMOS Mll的襯底連接去使能信號提供節(jié)點(diǎn)nrail,漏極連接PMOS MlO的源極,源極連接電阻R3,柵極連接輸入信號in的第二信號eni_bar ;所述電平轉(zhuǎn)換電路32還包括NMOS M12,NMOS M12的襯底連接去使能信號提供節(jié)點(diǎn)nrai I,柵、漏極連接NMOS Mll的源極及電阻R3,源極連接電源地pwrn ;所述NMOS M12用于快速拉低使能信號輸出節(jié)點(diǎn)eni_rr的電平。步驟102 :所述電平轉(zhuǎn)換電路按照第一信號的高低電平進(jìn)行使能控制,所述電平轉(zhuǎn)換電路在電源掉電時輸出去使能信號;具體的,當(dāng)所述電平轉(zhuǎn)換電路32不包括用于限制電阻R3電流的NMOS Mll時,如圖3所示,在電源pwrin電壓VCC正常,輸入信號in為高電平時,接入電平轉(zhuǎn)換電路32的第一信號eni為高電平VCC,PM0S MlO導(dǎo)通,使能信號輸出節(jié)點(diǎn)eni_rr輸出使能信號VCC ;在電源pwrin電壓VCC正常,輸入信號in為低電平時,接入電平轉(zhuǎn)換電路32的第一信號eni為低電平0,PMOS MlO截止,通過下拉電阻R3將使能信號輸出節(jié)點(diǎn)eni_rr的電平拉低至去使能信號提供節(jié)點(diǎn)nrail的電平Vnrail,使能信號輸出節(jié)點(diǎn)eni_rr輸出去使能信號Vnrail ;在電源掉電時,緩沖器31停止工作,不論輸入信號in的電壓為多少,接入電平轉(zhuǎn)換電路32的第一信號eni為低電平0,PMOS MlO截止,通過電阻R3將使能信號輸出節(jié)點(diǎn)eni_rr的電平拉低至去使能信號提供節(jié)點(diǎn)nrail的電平Vnrail,使能信號輸出節(jié)點(diǎn)eni_rr輸出去使能信號Vnrail ;當(dāng)所述電平轉(zhuǎn)換電路32包括用于限制電阻R3電流的NMOS Mll時,所述電平轉(zhuǎn)換電路32按照第一信號、第二信號的高低電平進(jìn)行使能控制。如圖4所示,在電源pwrin電壓VCC正常,輸入信號in為高電平時,接入電平轉(zhuǎn)換電路32的第一信號eni為高電平VCC,第二信號eni_bar為低電平0,PM0S MlO導(dǎo)通,根據(jù)去使能信號提供節(jié)點(diǎn)nrail的電平Vnrail小于負(fù)的NMOS Mll導(dǎo)通閾值,NMOS Mll導(dǎo)通,使能信號輸出節(jié)點(diǎn)eni_rr輸出使能信號VCC;在電源pwrin電壓VCC正常,輸入信號in為低電平時,接入電平轉(zhuǎn)換電路32的第一信號eni為低電平0,第二信號eni_bar為高電平VCC,PMOS MlO截止,NM0SM11導(dǎo)通,通過下拉電阻R3將使能信號輸出節(jié)點(diǎn)eni_rr的電平拉低至去使能信號提供節(jié)點(diǎn)nrail的電平Vnrail,使能信號輸出節(jié)點(diǎn)eni_rr輸出去使能信號Vnrail ;在電源掉電時,緩沖器31停止工作,不論輸入信號in的電壓為多少,接入電平轉(zhuǎn)換電路32的第一信號eni為低電平0,第二信號eni_bar為低電平0,PM0S MlO截止,根據(jù)去使能信號提供節(jié)點(diǎn)nrail的電平Vnrail小于負(fù)的NM0SM11導(dǎo)通閾值,NMOS Mll導(dǎo)通,通過電阻R3將使能信號輸出節(jié)點(diǎn)eni_rr的電平拉低至去使能信號提供節(jié)點(diǎn)nrail的電平Vnrail,使能信號輸出節(jié)點(diǎn)eni_rr輸出去使能信號Vnrail ;如圖4所示的所述電平轉(zhuǎn)換電路32,本步驟還包括在電源pwrin電壓VCC正常,輸入信號in為低電平時,通過NMOS M12快速拉低使能信號輸出節(jié)點(diǎn)eni_rr的電平。上述方法中,所述第一信號為輸入信號的正信號;所述第二信號為輸入信號的反信號?;诒緦?shí)用新型軌到軌使能信號的控制方法,本實(shí)用新型提供了一種電平轉(zhuǎn)換電路,如圖3所示,所述電平轉(zhuǎn)換電路32包括PM0S M10、電阻R3 ;其中,所述PMOS M10,配置為在漏極接收輸入信號in的第一信號eni,按照第一信號eni的高低電平,控制自身狀態(tài)為導(dǎo)通或截止;所述第一信號eni在電源pwrin掉電時為低電平;所述電阻R3,配置為在PMOS MlO導(dǎo)通時,保持使能信號輸出節(jié)點(diǎn)eni_rr輸出使能信號;在PMOS MlO截止時,保持使能信號輸出節(jié)點(diǎn)eni_rr輸出去使能信號;所述PMOS M10、電阻R3的具體連接關(guān)系為PM0S MlO的襯底連接電源pwrin,漏極連接輸入信號in的第一信號eni,源極連接電阻R3,柵極連接電源地pwrn ;電阻R3在PMOSMlO的源極和去使能信號提供節(jié)點(diǎn)nrail之間;所述去使能信號提供節(jié)點(diǎn)nrail的電平不高于電源地pwrn ;所述電平轉(zhuǎn)換電路32還包括NMOS M11,如圖4所示,配置為在柵極接收輸入信號in的第二信號eni_bar,在電源pwrin電壓正常或掉電時,控制自身狀態(tài)為導(dǎo)通,限制電阻R3的電流;所述NMOS MlI設(shè)置在PMOS MlO與電阻R3之間,所述NMOS MlI的襯底連接去使能信號提供節(jié)點(diǎn)nrai I,漏極連接PMOS MlO的源極,源極連接電阻R3,柵極連接輸入信號in的第二信號eni_bar ;所述電平轉(zhuǎn)換電路32還包括NMOS M12,如圖4所示,配置為在電源pwrin電壓VCC正常,輸入信號in為低電平時,快速拉低使能信號輸出節(jié)點(diǎn)eni_rr的電平;所述NMOS M12的襯底連接去使能信號提供節(jié)點(diǎn)nrail,柵、漏極連接NMOS Mll的源極及電阻R3,源極連接電源地pwrn?;谏鲜隹刂品椒ê碗娖睫D(zhuǎn)換電路,本實(shí)用新型還提供一種軌到軌使能信號的控制電路,如圖3所示,該控制電路包括電平轉(zhuǎn)換電路32,配置為接收輸入信號in的第一信號eni,按照第一信號eni的高低電平進(jìn)行使能控制;在電源掉電時輸出去使能信號。所述電平轉(zhuǎn)換電路32包括PM0S M10、電阻R3 ;其中,所述PMOS MlO,配置為在漏極接收輸入信號in的第一信號eni,根據(jù)第一信號eni的高低電平,控制自身狀態(tài)為導(dǎo)通或截止;所述第一信號eni在電源pwrin掉電時為低電平;所述電阻R3,配置為在PMOS MlO導(dǎo)通時,保持使能信號輸出節(jié)點(diǎn)eni_rr輸出使能信號;在PMOS MlO截止時,保持使能信號輸出節(jié)點(diǎn)eni_rr輸出去使能信號;所述PMOS M10、電阻R3的具體連接關(guān)系為PM0S MlO的襯底連接電源pwrin,漏極連接輸入信號in的第一信號eni,源極連接電阻R3,柵極連接電源地pwrn ;電阻R3在PMOSMlO的源極和去使能信號提供節(jié)點(diǎn)nrail之間;所述去使能信號提供節(jié)點(diǎn)nrail的電平不高于電源地pwrn ;所述電平轉(zhuǎn)換電路32還包括NMOS M11,如圖4所示,配置為在柵極接收輸入信號in的第二信號eni_bar,在電源pwrin電壓正?;虻綦姇r,控制自身狀態(tài)為導(dǎo)通,限制電阻R3的電流; 所述NMOS MlI設(shè)置在PMOS MlO與電阻R3之間,所述NMOS MlI的襯底連接去使能信號提供節(jié)點(diǎn)nrai I,漏極連接PMOS MlO的源極,源極連接電阻R3,柵極連接輸入信號in的第二信號eni_bar ;所述電平轉(zhuǎn)換電路32還包括NMOS M12,如圖4所示,配置為在電源pwrin電壓VCC 正常,輸入信號in為低電平時,快速拉低使能信號輸出節(jié)點(diǎn)eni_rr的電平;所述NMOS M12的襯底連接去使能信號提供節(jié)點(diǎn)nrail,柵、漏極連接NMOS Mll的源極及電阻R3,源極連接電源地pwrn ;該控制電路還包括緩沖器31,如圖3所示,配置為獲得輸入信號in的第一信號eni,將第一信號eni接入電平轉(zhuǎn)換電路32的PMOS MlO的漏極;所述緩沖器31,如圖4所示,還配置為獲得輸入信號in的第二信號eni_bar,將第ニ信號eni_bar接入電平轉(zhuǎn)換電路32的NMOS Mll的柵極。本實(shí)用新型對上述圖4所示的軌到軌使能信號的控制電路進(jìn)行仿真測試如圖5、6所示,其中,由圖5可知,電源電壓VCC = 0V,輸入信號Vin = -2V,去使能信號提供節(jié)點(diǎn)nrail的電平Vnrail = -2V,在I秒(s)內(nèi)檢測6次,輸出去使能信號Vout = Vnrail=-2V ;由圖6可知,電源電壓VCC = 0V,輸入信號Vin = 2V,去使能信號提供節(jié)點(diǎn)nrail的電平Vnrail = 0V,在I秒(s)內(nèi)檢測6次,輸出去使能信號均為Vout = Vnrail =I.51408nV ^ 0V。由仿真測試可以看出,本實(shí)用新型的軌到軌使能信號的控制電路,在電源掉電時,能夠一直輸出去使能信號,為接受使能控制的設(shè)備提供準(zhǔn)確的使能控制信號。以上所述,僅為本實(shí)用新型的較佳實(shí)施例而已,并非用于限定本實(shí)用新型的保護(hù)范圍。
權(quán)利要求1.ー種電平轉(zhuǎn)換電路,其特征在于,所述電平轉(zhuǎn)換電路包括 根據(jù)第一信號的高低電平控制自身狀態(tài)為導(dǎo)通或截止的P溝道金屬氧化物半導(dǎo)體場效應(yīng)管PMOS (MlO),所述PMOS (MlO)的漏極連接所述第一信號;所述第一信號在電源掉電時為低電平; 在所述PMOS(MlO)導(dǎo)通時,保持使能信號輸出節(jié)點(diǎn)輸出使能信號;在所述PMOS(MlO)截止時,保持使能信號輸出節(jié)點(diǎn)輸出去使能信號的電阻(R3)。
2.根據(jù)權(quán)利要求I所述電平轉(zhuǎn)換電路,其特征在于,所述PMOS(MlO)的襯底連接電源,漏極連接輸入信號的第一信號,源極連接電阻(R3),柵極連接電源地;電阻(R3)在PMOS(MlO)的源極和去使能信號提供節(jié)點(diǎn)之間。
3.根據(jù)權(quán)利要求I所述的電平轉(zhuǎn)換電路,其特征在于,所述電平轉(zhuǎn)換電路還包括在柵極接收輸入信號的第二信號,在電源電壓正?;虻綦妳迹刂谱陨頎顟B(tài)為導(dǎo)通,限制電阻(R3)的電流的N溝道金屬氧化物半導(dǎo)體場效應(yīng)管NMOS (Ml I); 所述NMOS (MlI)在PMOS (MlO)與電阻(R3)之間,所述NMOS (Mll)的襯底連接去使能信號提供節(jié)點(diǎn),漏極連接PMOS(MlO)的源極,源極連接電阻(R3),柵極連接輸入信號的第二信號。
4.根據(jù)權(quán)利要求3所述的電平轉(zhuǎn)換電路,其特征在于,所述電平轉(zhuǎn)換電路還包括在電源電壓正常,輸入信號為低電平時,快速拉低使能信號輸出節(jié)點(diǎn)的電平的NMOS(M12); 所述NM0S(M12)的襯底連接去使能信號提供節(jié)點(diǎn),柵極、漏極連接所述NMOS(MlI)的源極及所述電阻(R3),源極連接電源地。
5.一種軌到軌使能信號的控制電路,其特征在于,該控制電路包括接收輸入信號的第一信號,按照第一信號的高低電平進(jìn)行使能控制;在電源掉電時輸出去使能信號的電平轉(zhuǎn)換電路。
6.根據(jù)權(quán)利要求5所述的控制電路,其特征在于,所述電平轉(zhuǎn)換電路,包括 根據(jù)第一信號的高低電平控制自身狀態(tài)為導(dǎo)通或截止的PMOS(MlO),所述PMOS(MlO)的漏極連接所述第一信號;所述第一信號在電源掉電時為低電平; 在所述PMOS(MlO)導(dǎo)通時,保持使能信號輸出節(jié)點(diǎn)輸出使能信號;在所述PMOS(MlO)截止時,保持使能信號輸出節(jié)點(diǎn)輸出去使能信號的電阻(R3)。
7.根據(jù)權(quán)利要求6所述的控制電路,其特征在于,所述PMOS(MlO)的襯底連接電源,漏極連接輸入信號的第一信號,源極連接電阻(R3),柵極連接電源地;電阻(R3)在PMOS (MlO)的源極和去使能信號提供節(jié)點(diǎn)之間。
8.根據(jù)權(quán)利要求6所述的控制電路,其特征在于,該控制電路還包括獲得輸入信號的第一信號的緩沖器,所述緩沖器獲得的第一信號接入所述電平轉(zhuǎn)換電路的所述PMOS(MlO)的漏極。
9.根據(jù)權(quán)利要求8所述的控制電路,其特征在干,所述電平轉(zhuǎn)換電路還包括在柵極接收輸入信號的第二信號,在電源電壓正常或掉電時,控制自身狀態(tài)為導(dǎo)通,限制電阻(R3)的電流的NMOS(Mll); 所述NMOS (MlI)在PMOS (MlO)與電阻(R3)之間,所述NMOS (Mll)的襯底連接去使能信號提供節(jié)點(diǎn),漏極連接PMOS(MlO)的源極,源極連接電阻(R3),柵極連接輸入信號的第二信號。
10.根據(jù)權(quán)利要求9所述的控制電路,其特征在于,所述電平轉(zhuǎn)換電路還包括在電源電壓VCC正常,輸入信號為低電平時,快速拉低使能信號輸出節(jié)點(diǎn)的電平的NMOS(M12); 所述NM0S(M12)的襯底連接去使能信號提供節(jié)點(diǎn),柵極、漏極連接所述NMOS(Mil)的源極及所述電阻(R3),源極連接電源地。
11.根據(jù)權(quán)利要求9所述的控制電路,其特征在于,該控制電路還包括獲得輸入信號的第二信號的緩沖器,所述緩沖器獲得的第二信號接入所述電平轉(zhuǎn)換電路的所述NMOS (Mll)的柵極。
專利摘要本實(shí)用新型公開了一種軌到軌使能信號的控制電路,該控制電路包括接收輸入信號的第一信號,按照第一信號的高低電平進(jìn)行使能控制;在電源掉電時輸出去使能信號的電平轉(zhuǎn)換電路;本實(shí)用新型同時還公開了一種電平轉(zhuǎn)換電路,通過本實(shí)用新型的方案,能夠在電源電壓正常時,根據(jù)輸入信號的高低電平輸出相應(yīng)的軌到軌的使能控制信號,在電源掉電時,正常輸出去使能信號,為接受使能控制的設(shè)備提供準(zhǔn)確的使能控制信號。
文檔編號H03K19/0185GK202602615SQ20122008950
公開日2012年12月12日 申請日期2012年3月7日 優(yōu)先權(quán)日2012年3月7日
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