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雙?;パa型金屬氧化物半導(dǎo)體集成成像器的制作方法

文檔序號:7661738閱讀:150來源:國知局
專利名稱:雙模互補型金屬氧化物半導(dǎo)體集成成像器的制作方法
技術(shù)領(lǐng)域
本發(fā)明涉及一種單片成像系統(tǒng),更具體地說是涉及一種能夠以片內(nèi)產(chǎn)生的時序信號或以自一外部源接收到的時序信號來操作的成像系統(tǒng)。
在設(shè)計現(xiàn)有技術(shù)的成像系統(tǒng)時,曾試圖設(shè)計這樣的系統(tǒng),它使噪聲最小化,由此產(chǎn)生一緊密跟蹤圖像的輸出,并使該裝置的整體尺寸最小化。另外,有人曾試圖制造與互補型金屬氧化物半導(dǎo)體(CMOS)技術(shù)兼容的成像系統(tǒng),目的是能通過由CMOS或一些其它低功耗邏輯系列制成的控制電路來減小系統(tǒng)中總功耗。例如,授予Fossum等人的美國專利No.5,841,126揭示了一種成像系統(tǒng),在該系統(tǒng)中將控制器電子電路與光敏組件設(shè)備集成在同一基板上。Fossum等人的裝置與CMOS兼容,并因控制系統(tǒng)組件(諸如積分、定時、A/D轉(zhuǎn)換等)被與光敏組件集成在同一基板上而使裝置的尺寸和功率消耗減小。
本發(fā)明的發(fā)明者已證實某些成像系統(tǒng)的用戶需要有一簡易系統(tǒng),它要求數(shù)量較少的信號來控制圖像。然而,其它用戶卻希望把其特有所時序供給成像系統(tǒng)或者需要可與一外部FPGA或其它包括了時鐘和時序控制的其它裝置兼容的成像系統(tǒng)。因此,最好是生產(chǎn)一種可在兩種不同時序協(xié)議下操作的成像系統(tǒng)。
在現(xiàn)有技術(shù)中,眾所周知對于特定信號有不同的時序協(xié)議。例如,有一些專利揭示了可讀取兩種不同長度的信號,例如,授予Chesley等人的美國專利No.5,394,541;授予MacKenna等人的美國專利No.5,495,594;授予Wright等人的美國專利No.5,587,961;以及授予Vogley的美國專利No.5,615,358。然而,這些專利涉及一特定時序信號的改變,而并非將不是使用外部時序系統(tǒng)就是使用一在成像裝置中完整地發(fā)生的時序系統(tǒng)的選擇提供給用戶。
歷史上,成像系統(tǒng)是由若干分立部件裝配而成并已具有一數(shù)字部分和一模擬部分。為達(dá)到最大效能以及鑒別其制品,研究者們已使控制模擬部分(例如,圖像陣列、信號鏈、模擬/數(shù)字轉(zhuǎn)換器)的時序和偏置(bias)控制最優(yōu)化。對于集成系統(tǒng)有一允許類似存取的值。
本發(fā)明的目的是提供一種CMOS集成成像器系統(tǒng),該系統(tǒng)既可以使用一內(nèi)部時序元件的第一模式操作又可以使用一外部時序元件的第二模式操作。
本發(fā)明的另一目的是提供一種具有一內(nèi)部時序元件的成像器系統(tǒng),該時序元件減少了控制在端點使用應(yīng)用的成像器所需要的信號數(shù)目。
發(fā)明概述上述目的已由一CMOS集成成像器系統(tǒng)達(dá)成,該系統(tǒng)使用片內(nèi)邏輯以在片內(nèi)產(chǎn)生復(fù)合的時序。該成像器系統(tǒng)具有一接收數(shù)據(jù)、地址和控制信號的接口,所述信號包括一模式信號,它將系統(tǒng)設(shè)定為使用片內(nèi)時序系統(tǒng)來操作,或旁路片內(nèi)時序系統(tǒng)并使用一外部時序系統(tǒng)來操作。本發(fā)明的成像器可使用一易用的接口和簡單操作提供高質(zhì)量的圖像以減少時間和成本。如果用戶需要為高級成像而延續(xù)操作模式時,本發(fā)明還給用戶提供外部控制FPGA中的掃描時序的每一方面的選擇。
附圖簡要說明

圖1為本發(fā)明的總的成像器系統(tǒng)的方框圖,示出內(nèi)部和外部的兩時序選擇;圖2為本發(fā)明的成像器系統(tǒng)的方框圖;圖3為圖2的成像器系統(tǒng)的另一實施例的方框圖;圖4為圖2的成像器系統(tǒng)以一第一操作模式配置的方框圖;圖5為圖2的成像器系統(tǒng)以一第二操作模式配置的方框圖;圖6為圖2的成像器系統(tǒng)的圖像感測器陣列的方框圖;圖7為以第一操作模式中的行讀出和行消隱操作的開始方式的時序圖;
圖8A和8B為表示一短的第一幀圖像的時序圖;圖9為表示一行消隱選通的時序圖;圖10為表示一行讀出選通的時序圖;圖11為顯示一行讀出末尾的的時序圖;圖12為顯示一幀的末尾的時序圖;圖13為用于圖2的成像器系統(tǒng)中的像素陣列的電路簡圖;圖14為圖13中所示的像素陣列的時序圖。
本發(fā)明的較佳實施方式請參見圖1,圖中示出了具有內(nèi)部和外部時序選擇的本發(fā)明的成像器系統(tǒng)。成像器系統(tǒng)17包括一成像器探測芯片15,它具有多個寄存器21,一模擬/數(shù)字轉(zhuǎn)換塊23,一相關(guān)雙抽樣(CDS)塊25,以及一成像器陣列27。成像器系統(tǒng)17具有一內(nèi)部時序發(fā)生器31,它用以對控制時序總線35產(chǎn)生片內(nèi)時序。數(shù)據(jù)總線37把數(shù)據(jù)供給寄存器21。一旁通多路復(fù)用器29與控制總線35連接并用于旁通內(nèi)部時序發(fā)生器31以使用一外部時序塊19,它包括一時序現(xiàn)場可編程門陣列(FPGA)。當(dāng)用戶需要一專門時序協(xié)議時就使用該外部時序塊19。在該情況下,外部邏輯塊19利用所有的裝置引線與成像器17接合,然后,外部時序或邏輯塊19將所有時序和控制信號供給成像器17。由用戶限定的外部邏輯塊19包括一外部時序發(fā)生器和顏色恢復(fù)塊41,而且還包括一存儲器和DMA接口塊39。成像器17通過檢測兩條接收一模式信號的控制線33來識別兩種不同的時序模式。控制線33被檢測并將使用內(nèi)部時序操作,除非其中一條或全部控制線接收一具有邏輯電平值為“1”的信號。引線具有若干內(nèi)部下拉式電阻,如果左面未被連接或被限制在零伏電壓時,引線將自動迫使裝置進(jìn)到內(nèi)部時序。
請參見圖2,圖中示出了成像器系統(tǒng)17的詳細(xì)方框圖。成像器系統(tǒng)17具有一接口,該接口包括一數(shù)據(jù)端口42、一地址端口43以及一控制端口44。數(shù)據(jù)端口接收外部數(shù)據(jù)并將該數(shù)據(jù)供給數(shù)據(jù)總線37。地址信息是在地址端口43處接收的并供給地址總線36??刂菩盘柺窃诳刂贫丝?4處接收的并供給控制總線35。模擬控制信號由模擬控制塊88產(chǎn)生并供給數(shù)據(jù)總線37、地址總線36和控制總線35??刂瓶偩€多路復(fù)用器29與控制總線35連接,如上所述。當(dāng)系統(tǒng)處于外部時序模式時,控制總線多路復(fù)用器29用于旁通內(nèi)部時序發(fā)生器??刂瓶偩€多路復(fù)用器由一條或多條控制端口線上的信號作外部控制。成像器系統(tǒng)17包括一在圖6中詳細(xì)顯示的圖像感測器陣列27。請參見圖6,圖像感測器陣列27為一具有一43%的高物理填充因子的1283×480矩形有源像素的像素陣列(帶微透鏡)。一垂直帶狀RGB粘貼濾色片是與單獨的列相關(guān)雙抽樣(CDS)校正電路一起使用的以產(chǎn)生一低的固定樣式圖像噪聲電平。在X-軸線322上與21個暗像素和1個測試像素一道有1283個規(guī)則像素,在圖像感測器陣列的Y-軸線321上與9個暗像素和1個測試像素一道有480個規(guī)則像素。紅色365、綠色367和藍(lán)色369濾色片用于限定像素。
請再參閱圖2,圖像感測器邏輯塊52從數(shù)據(jù)總線37、地址總線36和控制總線35接收信號并產(chǎn)生行地址信號49和列地址信號47。列地址信號47輸入到一列譯碼器46,該列譯碼器46譯解供圖像感測器陣列27列選擇用的地址字并鎖存輸出。行地址信號49輸入到行譯碼器,該行譯碼器譯解為圖像感測器陣列27行選擇用的地址字。圖像感測器邏輯塊52為產(chǎn)生相關(guān)區(qū)域和二次抽樣讀出的行和列地址信號提供計數(shù)器。它還對靜態(tài)模式及觀景器模式的每一行產(chǎn)生重置和選擇時序。一微控制器和存儲器接口邏輯塊50也與數(shù)據(jù)總線37、地址總線36和控制總線35連接。接口邏輯塊譯解地址,產(chǎn)生寄存器尋址的核心選擇信號,并且還提供電源以及測試模式管理。圖像感測器陣列27將光學(xué)圖像轉(zhuǎn)換為分離色彩的模擬輸出電信號。該感測器陣列如前所述由行和列以數(shù)字方式尋址。三個模擬信號藍(lán)色69,綠色67和紅色65被供給一模擬增益和偏置塊60。模擬增益和偏置塊60為三個模擬信道提供可調(diào)節(jié)的偏置和增益,并將模擬增益和偏置塊60的輸出供給一模擬偏壓線路70。整體模擬增益塊54為三個模擬信道提供整體的增益,并在偏壓線路70上產(chǎn)生輸出。一A/D轉(zhuǎn)換器23將模擬信號轉(zhuǎn)換成數(shù)字字。
請參見圖3,圖中示出了本發(fā)明的另一實施例。在該實施例中,所有的模擬控制信號是由一外部源通過控制端口供給的。因此,如圖2所示的模擬邏輯塊88在本實施例中不是必要的。
請參見圖4,所示的成像器系統(tǒng)215以一第一操作模式配置。在此第一操作模式中,系統(tǒng)時序在圖像采集芯片217上產(chǎn)生。系統(tǒng)215包括圖像采集芯片217,并可包括一由用戶可選地提供的模擬控制塊288。圖像采集芯片217接收模擬電壓和接地信號220、數(shù)字電壓和接地信號221以及填充驅(qū)動器電壓和接地信號222。圖像采集芯片經(jīng)信號線254與控制總線244連接,經(jīng)信號線275與數(shù)據(jù)總線242連接,以及經(jīng)信號線274與地址總線243連接。模擬控制塊288通過信號線232、234、236和238與圖像采集芯片相互配合。微控制器250經(jīng)信號線251、252、253分別與數(shù)據(jù)總線、地址總線和控制總線連接,并通過寄存器載入和讀出以及通過一異步中斷來提供系統(tǒng)控制。
請參見圖5,所示的成像器系統(tǒng)115以一第二操作模式配置。在此第二操作模式中,系統(tǒng)時序是由一外部時序塊產(chǎn)生的,該外部時序塊包含一含有DMA控制173的FPGA/ASIC171。圖像采集芯片通過線路154連接到控制總線144,并通過線176和175連接到數(shù)據(jù)總線142。信號線123和124在圖像采集芯片117和DMA173之間供給信號,地址信號則通過線路174供給地址總線143。在其它方面,系統(tǒng)115與以上結(jié)合附圖4的描述相同的方式配置。
請參見圖6,各種信號被輸入到成像器系統(tǒng)信號的接口。線路307把總線電壓和接地信號供給模擬、數(shù)字及填充信號。數(shù)據(jù)端口42接收在信號線301上的10位寄存器值。地址端口43接收在信號線302上的4位寄存器地址??刂贫丝?4接收多個在信號線303上的控制信號,它們包括幀重置、行重置、信道轉(zhuǎn)換、芯片選擇,允許列、幀同步、行同步、列箝位、行選擇、像素基準(zhǔn)、像素的采樣、以及讀和寫信號。其中一個控制信號是一模式選擇信號333,該模式選擇信號333可選定裝置是以第一模式操作還是以第二模式操作。信號線305被輸入至像素測試偏置,信號線306為模擬輸入和模擬輸出信號。
當(dāng)成像器系統(tǒng)以第一模式操作時,時序在片內(nèi)發(fā)生。內(nèi)部時序如圖7-12所示。從圖7開始,圖中示出了用于行消隱和行讀出操作的開始樣式。行消隱顯示操作使成像器通過CDS塊產(chǎn)生一行完整的圖像,而行讀出操作處理把該圖像輸至數(shù)據(jù)總線。在圖7-12的每一個圖中,后繼的信號表示和定義如下??傮w設(shè)定(GS)501是一將寄存器調(diào)整到缺省值的信號。幀同步(nFS)502是一指示幀讀出的數(shù)字輸出信號。行同步(nLS)503是一指示行讀出的數(shù)字輸出信號。行讀(ROW-R)504是一開始行讀出操作的數(shù)字輸入信號。行消隱顯(ROW-B)505是一開始行消隱處理的數(shù)字輸入信號。確認(rèn)信號(ACK)506是一表示處理是否忙碌的數(shù)字輸出信號。像素同步(nPIX)507信號是一表示像素讀出的數(shù)字輸出信號。一芯片選擇信號(nCS)508準(zhǔn)許或預(yù)防止任何數(shù)據(jù)輸出至一特定數(shù)據(jù)寄存器。寫入信號(nWR)509是一指示寫入周期的數(shù)字輸入信號。讀出信號(nRD)510是一指示讀出周期的數(shù)字輸入信號。圖中所示的還有地址寄存器(A)511以及數(shù)據(jù)輸入寄存器(D)512。地址寄存器511接收一4位寄存器輸入,而數(shù)據(jù)寄存器512接收10位讀/寫數(shù)據(jù)值。
靜態(tài)操作可使用一電子半光閘來達(dá)到,并藉由一用于高速曝光的外部機械光閘來增強。圖像感測器邏輯寄存器首先設(shè)定為111111111,并且成像器通過選通幀重置輸入(圖中未示)高電平來重新設(shè)定。曝光時間在外部控制過程下確定,可以是和一個確認(rèn)周期一樣短的時間或如用戶需要的那樣長的時間。在曝光時段后,成像器從圖像感測器邏輯寄存器中規(guī)定區(qū)域的左下角部開始的基線被逐行地讀出。選通行消隱線505高使成像器能通過CDS塊處理一完整的行圖像。當(dāng)上述周期完成后,成像器使確認(rèn)信號506下降為低并為數(shù)據(jù)流輸出作好準(zhǔn)備。
如圖7所示,在總體設(shè)定時段520期間,總體設(shè)定信號501將寄存器調(diào)整到缺省值。然后,在時段521期間,寫入信號509變低以寫入數(shù)據(jù)寄存器512。當(dāng)寫入信號509回復(fù)至高以后,芯片選擇信號508被觸發(fā)且行消隱信號505也在同一時間被觸發(fā)為確認(rèn)信號506。這使得行消隱處理522開始,如上所述。當(dāng)行消隱處理完成后,行讀出處理523將開始。行讀出信號504被保持在高電平且成像器把數(shù)據(jù)以每兩個主時鐘周期一個象素的最大速率加于總線,所述主時鐘周期表示在(nPIX)507信號的下降緣上的良好的數(shù)據(jù)。
請參見圖8A和8B,圖中示出了數(shù)據(jù)的一短的第一幀的時序圖。圖8A的第一部分與上面參照圖7所作的描述相同,即描述了行消隱和行讀出周期開始處的信號。在一主時鐘周期的一半處,緊隨一行中最后像素的nPIX信號507的最后下降緣,成像器也降低行同步信號503以指定一行同步。再次選通行消隱信號505使第二行被讀出,以此類推。當(dāng)最后行讀出后,成像器也使幀同步信號502降低與行同步信號503一致以指定一幀同步。該過程如圖8A中相對于時段524所示。然后,參見圖8B,在時段525,行讀出和行消隱重復(fù)所有的行,然后當(dāng)該過程完成后,幀同步信號(nFS)502下降。
雖然機械光閘可用于防止在開始讀出圖像以后的直接曝光,但像素將繼續(xù)累積暗電流。讀出期間,一旦光閘被關(guān)閉,相對于曝光時間應(yīng)保持盡可能短以避免圖畫亮度逐漸降低。由于系統(tǒng)或傳輸信道的限制,如果這是不可能的話,那么可補充一種簡單的算法來作校正。下一幀曝光通過選通幀重置信號重新開始。后繼圖像的幀將含有完全有效數(shù)據(jù),因重置和讀出點將會平穩(wěn)地環(huán)繞該圖像器。在等待時間通過編程送入曝光寄存器的曝光數(shù)據(jù)確定之后,實際的圖像數(shù)據(jù)可在輸出處得到。為接收數(shù)據(jù),當(dāng)每行的行消隱信號被確認(rèn)并將數(shù)據(jù)閂鎖在像素(nPIX)信號507的下降緣上后,用戶選通行讀出信號。用戶必須足夠早地選通行讀信號,這樣,一行中最后的像素在下一行消隱選通被加上之前輸出以避免數(shù)據(jù)被削減。
圖9表示行消隱處理522開始的詳細(xì)視圖。圖中示出了另一信號,主時鐘信號515。如圖所示,芯片選擇信號508在主時鐘信號的上升緣上開始。開始坐標(biāo)被加載至內(nèi)部開始寄存器內(nèi)且主計數(shù)器被重置為內(nèi)部開始寄存器的內(nèi)容。在芯片選擇信號508的下降緣上,這會觸發(fā)從寄存器至計數(shù)器的轉(zhuǎn)移。確認(rèn)信號506然后降低以指示行消隱信號可開始,行消隱信號505由高變低以開始行消隱程序。當(dāng)確認(rèn)信號變高時,這表明內(nèi)部開始機制已完成最后的行消隱過程。
請參見圖10,圖中示出了行讀出選通523。確認(rèn)信號506被再次選通以指示行讀出可開始以及行讀出信號504被選通以開始行讀出處理。幀同步和行同步信號如同行讀出處理開始那樣而變高。當(dāng)nPIX信號507被觸發(fā),數(shù)據(jù)將在數(shù)據(jù)寄存器中被讀出,以紅色像素、綠色像素和藍(lán)色像素形式顯示。
請參見圖11,圖中示出了行讀出末尾以及下一行消隱時段525的開始。當(dāng)行中最后的像素被讀出時,行同步信號503變低并終止行讀出。確認(rèn)信號506然后也變成低的。為啟動下一行消隱時段,確認(rèn)信號變成高的,之后行消隱信號也變成高。請參見圖12,在幀530的末尾,幀同步和行同步信號502、503都變低以終止幀。
請參見圖13和14,圖中示出了用于本發(fā)明的圖像感測器中的像素陣列900。該像素陣列可以是現(xiàn)有技術(shù)中已知的任一類型的像素陣列。用于本發(fā)明中的像素陣列900是一種三晶體管電壓模式光電二極管布置。像素具有一重置晶體管902,該晶體管具有一與電壓重置偏壓線901連接的漏極端子和一接收重置信號(Trst)的晶體管的柵極端子。光電二極管907的陽極接地,而陰極與重置晶體管902的源極連接。一緩沖晶體管903的漏極與重置偏壓線901連接,而柵極端子與光電二極管907的陰極連接。一選擇晶體管904的源極端子與緩沖晶體管903的源極端子連接并在其柵極端子上接收一選擇信號TSEL。選擇晶體管904的漏極端子與電壓輸出線909連接。電壓輸出線(VOUT)909與電流源908連接并包括一列相關(guān)雙抽樣(CDS)電路905,以及一列譯碼器906。
圖14所示為選擇信號941、重置信號942、光電二極管943以及輸出電壓944的時序圖。為初始化像素,與每行中的其它晶體管同樣的重置晶體管902被接通,且光電二極管有源區(qū)充電至電壓重置偏壓線901的電位。當(dāng)重置晶體管902被截斷以開始累積時段930時,光電二極管907開始放電,它使內(nèi)在電容器放電,并且其電壓電平通過行選擇晶體管904被緩沖晶體管903緩沖。在累積完成后,行選擇晶體管904藉由選擇信號941的觸發(fā)而接通。選擇晶體管是與一行內(nèi)的其它選擇晶體管一樣的。當(dāng)選擇晶體管904被接通,像素電壓就出現(xiàn)在行讀出總線909上。如果繼續(xù)照明或直到它通過觸發(fā)重置信號(TRST)被再次重置,以重置準(zhǔn)備另一曝光時段的重置晶體管902,光電二極管將會繼續(xù)累積。重置后,讀出周期932開始且輸出電壓線909上的每一列的電壓被讀出。
權(quán)利要求
1.一種改進(jìn)的互補型金屬氧化物半導(dǎo)體集成成像器系統(tǒng),它具有帶有至少有一控制區(qū)的像素區(qū)陣列,其中所述像素區(qū)包括多個光收集元件,每一元件都接收光并用表示在積分階段接收的光量的數(shù)量來儲存電子信息,而所述控制區(qū)具有一內(nèi)部時序元件,其中改進(jìn)包括一用于接收多個數(shù)據(jù)信號、地址信號和控制信號的接口,所述接口接收一將系統(tǒng)設(shè)定在一第一操作模式或一第二操作模式之一的模式信號,其特征在于,所述第一操作模式使用內(nèi)部時序元件來控制系統(tǒng)的時序操作,所述第二操作模式旁路內(nèi)部時序元件來控制系統(tǒng)的時序操作。
2.如權(quán)利要求1所述的成像器系統(tǒng),其特征在于,所述控制區(qū)包括與所述接口電耦合的一數(shù)據(jù)總線、一地址總線以及一控制總線,它還包括一與控制總線連接的旁通多路復(fù)用器,在接收第一模式信號時操作多路復(fù)用器使所述內(nèi)部時序元件與所述控制總線互連,當(dāng)接收第二模式信號時操作多路復(fù)用器以旁通內(nèi)部控制元件。
3.如權(quán)利要求1所述的成像器系統(tǒng),其特征在于,所述成像器系統(tǒng)還包括當(dāng)系統(tǒng)以所述第二操作模式操作時接收來自一外部時序元件的時序信號的裝置。
4.如權(quán)利要求3所述的成像器系統(tǒng),其特征在于,所述外部時序元件包括一外部時序發(fā)生器和一色彩恢復(fù)塊。
5.如權(quán)利要求3所述的成像器系統(tǒng),其特征在于,所述外部時序塊包括一存儲器和一DMA接口塊。
6.如權(quán)利要求1所述的成像器系統(tǒng),其特征在于,當(dāng)所述接口未被接入接收所述模式信號時,所述成像器以第一操作模式操作。
7.一種用于互補型金屬氧化物半導(dǎo)體集成成像器的時序選擇器,其特征在于,其包括一板內(nèi)時序裝置,它與一互補型金屬氧化物半導(dǎo)體集成成像器相關(guān),用于提供標(biāo)準(zhǔn)時序信號以操作集成成像器上的一時鐘電路;一板外邏輯電路,它與所述互補型金屬氧化物半導(dǎo)體集成成像器電連接,該電路產(chǎn)生由一用戶建立的信號以確立用戶為成像器操作客戶化而限定的時序信號;以及一可選擇所述板內(nèi)時序裝置或板外邏輯電路的用戶接口。
8.如權(quán)利要求7所述的裝置,其特征在于,所述板外邏輯電路具有產(chǎn)生旁通所述時鐘電路的時鐘信號的裝置。
9.如權(quán)利要求7所述的裝置,其特征在于,所述板外邏輯電路具有使用所述時鐘電路產(chǎn)生時鐘信號的裝置。
全文摘要
一種在單個集成電路上形成的CMOS集成成像器系統(tǒng)(17),它具有一第一模式,在此模式中該系統(tǒng)利用片內(nèi)邏輯(31)進(jìn)行操作來在片內(nèi)發(fā)生復(fù)合的時序并利用該時序來操作,該系統(tǒng)還包括一第二操作模式,其中所述片內(nèi)邏輯被旁通(29)并利用一外部時序(19)系統(tǒng)。
文檔編號H04N5/335GK1444825SQ01813628
公開日2003年9月24日 申請日期2001年6月1日 優(yōu)先權(quán)日2000年6月1日
發(fā)明者R·D·麥克格拉斯, V·S·克拉克, B·H·羅克尼, S·達(dá)利沃爾 申請人:愛特梅爾股份有限公司
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