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技術(shù)編號：11434101

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本發(fā)明涉及一種動態(tài)存取存儲體(以下稱作DRAM)等揮發(fā)性半導(dǎo)體存儲裝置的再新(refresh)控制電路及方法與揮發(fā)性半導(dǎo)體存儲裝置。背景技術(shù)圖1是表示現(xiàn)有例的DRAM的存儲單元(memorycell)MC1與再新控制電路的結(jié)構(gòu)例的電路圖。圖1中，包括再新控制器10以及鎖存型讀出放大器11(latch-typesenseamplifier)，位線BL及/BL連接至鎖存型讀出放大器11，通常存儲用存儲單元MC1是具備金屬氧化物半導(dǎo)體(MetalOxideSemiconductor，MOS)晶體管(t...
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