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技術(shù)編號：11697492

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本發(fā)明涉及信息存儲領(lǐng)域，特別是涉及一種內(nèi)存調(diào)度方法及內(nèi)存控制器。背景技術(shù)目前，內(nèi)存控制器對動態(tài)隨機存儲器(DRAM，DynamicRandomAccessMemory)的隨機訪問受到DRAM固有參數(shù)(見表1)的影響，寫入的命令與命令之間存在間隔周期，而這間隔周期造成總線空閑。表1現(xiàn)有的實現(xiàn)DRAM訪問的硬件架構(gòu)包括內(nèi)存控制器和兩片X16DDR3內(nèi)存(SDRAM，SynchronousDynamicRandomAccessMemory)，兩片X16DDR3SDRAM物理上共享地址/命令(ADDR/...
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