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可編程硬加速芯片陣列的制作方法技術(shù)資料下載

技術(shù)編號(hào):6357964

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此技術(shù)為計(jì)算機(jī)系統(tǒng)架構(gòu)領(lǐng)域。背景技術(shù)此技術(shù)通過(guò)設(shè)計(jì)新的計(jì)算機(jī)系統(tǒng)架構(gòu),提升計(jì)算機(jī)硬件、軟件的運(yùn)作效率。 傳統(tǒng)的計(jì)算機(jī)架構(gòu),硬件效率飛速增長(zhǎng),但軟件的效率提升緩慢,限制了計(jì)算機(jī)整體性能的提高。本技術(shù)通過(guò)給計(jì)算機(jī)體系結(jié)構(gòu)上增加可編程硬加速芯片陣列,以提升計(jì)算機(jī)的整體性能。發(fā)明內(nèi)容本技術(shù)的基本原理在標(biāo)準(zhǔn)的計(jì)算機(jī)架構(gòu)(CPU (運(yùn)算器、控制器)、內(nèi)存、外部存儲(chǔ)器、I/o設(shè)備)的基礎(chǔ)上,在系統(tǒng)總線上增加可編程硬加速芯片陣列模塊結(jié)構(gòu),對(duì)計(jì)算機(jī)的硬件和軟件進(jìn)行加速,從而...
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