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多線程處理器中用于降低線程切換時(shí)延的方法和裝置的制作方法技術(shù)資料下載

技術(shù)編號(hào):6414035

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本發(fā)明一般涉及多線程處理器中用于降低線程切換時(shí)延的方法和裝置?,F(xiàn)在,用于高性能、單片微處理器的最常用的結(jié)構(gòu)是采用精簡(jiǎn)指令集計(jì)算機(jī)的RISC結(jié)構(gòu)。由于半導(dǎo)體技術(shù)的發(fā)展,RISC結(jié)構(gòu)的目標(biāo)已成為開發(fā)出差不多在每個(gè)機(jī)器的時(shí)鐘周期都能啟動(dòng)一條指令的處理器設(shè)計(jì)。這種每條指令時(shí)鐘周期數(shù)或稱為CPI的度量標(biāo)準(zhǔn)被經(jīng)常用于表征高性能處理器的結(jié)構(gòu)。指令流水線技術(shù)及高速緩沖存儲(chǔ)器結(jié)構(gòu)特征已使得CPI的改善成為可能。流水線指令的執(zhí)行使得后面的指令在前面已發(fā)出的指令執(zhí)行完之前就可開...
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