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一種處理器訪問慢速存儲(chǔ)器的控制方法技術(shù)資料下載

技術(shù)編號(hào):6574109

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本發(fā)明涉及存儲(chǔ)器訪問,尤其涉及一種訪問慢速存儲(chǔ)器的控 制方法。背景技術(shù)目前處理器的工作頻率在不斷提高,處理器與存儲(chǔ)器這類接口器件的 數(shù)據(jù)傳輸速率也相應(yīng)的提高。在慢速存儲(chǔ)器與高速處理器之間數(shù)據(jù)傳輸速 率不匹配的情況下,容易產(chǎn)生數(shù)據(jù)讀取的可靠性低的問題。如圖1,通常情況下慢速存儲(chǔ)器通過提供準(zhǔn)備就緒信號(hào)(READY),指 示訪問過程的狀態(tài)。一般地,READY《言號(hào)屬于開漏(open drain)和開集(open collector)輸出,需要外部加相應(yīng)的上下拉電...
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