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具備能抑制消耗電流的接口電路的半導(dǎo)體存儲器的制作方法技術(shù)資料下載

技術(shù)編號:6747326

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本發(fā)明涉及半導(dǎo)體存儲器,特別是涉及能以多種工作模式工作的結(jié)構(gòu),即用于實現(xiàn)半導(dǎo)體存儲器的低消耗電流和高速工作的結(jié)構(gòu)。使用附圖說明圖11簡單地說明現(xiàn)有的半導(dǎo)體存儲器。圖11中示出的現(xiàn)有的半導(dǎo)體存儲器9000具備輸入緩沖器1.1、1.2、…、1.m、內(nèi)部電路900和輸出緩沖器9.1、9.2、…、9.n。輸入緩沖器1.1、1.2、…、1.m(以下,總稱為輸入緩沖器1)分別判定從外部傳送來的信號EXT1、EXT2、…、EXTm的邏輯電平,生成對應(yīng)的邏輯電平的內(nèi)部信號...
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