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窄設(shè)計(jì)窗為目標(biāo)的面積有效高電壓基于雙極的esd保護(hù)的制作方法技術(shù)資料下載

技術(shù)編號(hào):7164120

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本發(fā)明一般地針對(duì)集成電路裝置及其制造方法。一方面,本發(fā)明涉及用于集成電路及其它電路中的靜電放電(ESD)保護(hù)的半導(dǎo)體裝置的制造和使用。背景技術(shù)為了保護(hù)不受集成電路裝置中的靜電放電(ESD)情況的影響,ESD筘位電路通常被提供作為跨這樣的集成電路裝置的輸入端子和/或其它端子的電壓限制裝置。用于設(shè)計(jì) ESD筘位電路的傳統(tǒng)方法包括在受保護(hù)的端子之間使用雙極型晶體管和/或可控硅整流器電路(又稱閘流晶體管電路),受保護(hù)的端子在觸發(fā)閾值電壓Vt處接通,并且當(dāng)跨受保護(hù)的...
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