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技術(shù)編號(hào)：7515262

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半導(dǎo)體集成電路、半導(dǎo)體集成電路的控制方法及終端系統(tǒng) 發(fā)明領(lǐng)域本發(fā)明涉及一種抑制因多個(gè)邏輯塊間的時(shí)效劣化引起的時(shí)鐘偏移增大 的技術(shù)。背景技術(shù)目前，對(duì)于在LSI (Large Scale Integration大規(guī)模集成電路)設(shè)計(jì)中 已被廣泛使用的同步設(shè)計(jì)方式而言，控制用的時(shí)鐘信號(hào)例如對(duì)保存狀態(tài)的 寄存器按相同的定時(shí)提供。在實(shí)際的LSI中，根據(jù)時(shí)鐘供應(yīng)電路結(jié)構(gòu)的不 同，在從時(shí)鐘發(fā)生源到寄存器之間產(chǎn)生于時(shí)鐘信號(hào)中的延遲量在寄存器間 有所不同。寄存器等元件間的延遲...
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該類技術(shù)注重原理思路，無完整電路圖，適合研究學(xué)習(xí)。

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