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技術(shù)編號(hào)：7518901

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本發(fā)明涉及在半導(dǎo)體集成電路中使相位誤差(殘留誤差)更低的PLL電路。背景技術(shù) 隨著LSI技術(shù)的微細(xì)化的高速發(fā)展，系統(tǒng)的時(shí)鐘和LSI內(nèi)部的相位誤差的余裕越來(lái)越少，補(bǔ)償該相位誤差的PLL電路的使用頻度越來(lái)越高。附圖說(shuō)明圖14是表示現(xiàn)有的PLL電路結(jié)構(gòu)的框圖。如該圖所示，PLL電路20由PFD(Phase Frequency Detector；相位比較器)21、CP(Charge Pump；充電泵)22、LF(Loop Filter；回路濾波器23、以及VCO(...
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該專(zhuān)利適合技術(shù)人員進(jìn)行技術(shù)研發(fā)參考以及查看自身技術(shù)是否侵權(quán)，增加技術(shù)思路，做技術(shù)知識(shí)儲(chǔ)備，不適合論文引用。
該類(lèi)技術(shù)注重原理思路，無(wú)完整電路圖，適合研究學(xué)習(xí)。

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