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技術(shù)編號：9827906

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本發(fā)明涉及電子通信領(lǐng)域，串行器/并行器(SERializer/DESerializer，SerDes) 0 SerDes是一種全數(shù)字電路設(shè)計的異步數(shù)據(jù)信號時鐘捕獲技術(shù)，該技術(shù)是基于FPGA來設(shè)計和實現(xiàn)的。一個標準的SerDes接口主要包括以下幾個模塊8b/10b編碼器、8b/10b解碼器、comma檢測器、并串轉(zhuǎn)換器、串并轉(zhuǎn)換器、時鐘數(shù)據(jù)信號恢復(Clock andData Recovery，(DR)、數(shù)字鎖相環(huán)(PhaseLockedLoop，PLL)等...
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