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具有PCIE和GPRS接口的復數乘乘運算裝置的制作方法

文檔序號:12004596閱讀:來源:國知局

技術特征:

1.一種具有PCIE和GPRS接口的復數乘乘運算裝置,其特征在于:具有:

對裝置進行控制的FPGA電路;

PCI Express電路;該電路的輸出端接FPGA電路的輸入端;

無線通信電路,該電路的輸入端接FPGA電路的輸出端。

2.根據權利要求1所述的具有PCIE和GPRS接口的復數乘乘運算裝置,其特征在于所述的FPGA電路為:集成電路U3的B2腳、A1腳、C3腳、B3腳、A3腳、C4腳、B4腳、A4腳、C5腳、B5腳、C6腳、A5腳、A6腳、A7腳、B7腳、C7腳、A8腳、A9腳、A10腳、C8腳、C9腳接PCI Express電路,集成電路U3的E1腳接晶振Y2的4腳,集成電路U3的H2腳、J2腳、H3腳、J1腳接連接器J1的5腳~2腳,集成電路U3的J4腳、K4腳接無線通信電路,集成電路U3的E7腳、F4腳、E4腳、G4腳、G6腳、F7腳、D6腳、D4腳接3V電源,集成電路U3的E5腳、G5腳、G7腳、F6腳、D7腳、D5腳、E6腳、F5腳接地,晶振Y2的3腳接地、1腳接3V電源,連接器J1的1腳接地;集成電路U3的型號為EPM240F100C4,晶振Y2的型號為JHY50M。

3.根據權利要求1所述的具有PCIE和GPRS接口的復數乘乘運算裝置,其特征在于所述的無線通信電路為:連接器J2與外部SIM9000A模塊連接,同時連接器J2的6腳和5腳接集成電路U3的J4腳和K4腳、2腳和7腳接地、1腳接5V電源。

4.根據權利要求1所述的具有PCIE和GPRS接口的復數乘乘運算裝置,其特征在于所述的PCI Express電路為:集成電路U1的21腳和20腳接集成電路U2的1腳和2腳、17腳接晶振Y1的一端和電容C1的一端、18腳接晶振Y1的另一端和電容C2的一端、62腳通過電阻R1接地、63腳通過電阻R2接地、11腳和12腳接連接器P1的14腳和15腳、15腳接電容C3的一端、14腳接電容C4的一端、5腳和6腳接連接器P1的24腳和23腳、10腳通過電阻R3接地、1腳接電容C5的一端和連接器P1的26腳,集成電路U1的57腳~60腳、39腳~46腳、26腳~22腳、34腳、53腳、27腳、50腳依次接集成電路U3的B2腳、A1腳、C3腳、B3腳、A3腳、C4腳、B4腳、A4腳、C5腳、B5腳、C6腳、A5腳、A6腳、A7腳、B7腳、C7腳、A8腳、A9腳、A10腳、C8腳、C9腳,集成電路U1的2腳、19腳、49腳接3V電源,集成電路U1的4腳、32腳、47腳、7腳、13腳接1.8V電源,集成電路U1的3腳、8腳、9腳、16腳、33腳、48腳、56腳、61腳接地,集成電路U2的電源端接3V電源、地端接地,電容C1、電容C2、電容C5的另一端接地,連接器P1的21腳接電容C3的另一端、20腳接電容C4的另一端,連接器P1的8腳、27腳、28腳、10腳接3V電源,連接器P1的1腳、2腳、34腳、35腳接12V電源的正極,連接器P1的4腳、7腳、13腳、16腳、18腳、19腳、22腳、25腳、33腳接地;集成電路U1的型號為CH382SSP、集成電路U2的型號為AT24C02。

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