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信息處理的方法、裝置和通信設(shè)備與流程

文檔序號(hào):40551770發(fā)布日期:2025-01-03 11:11閱讀:來(lái)源:國(guó)知局

技術(shù)特征:

1.一種信息處理的方法,包括:

2.根據(jù)權(quán)利要求1所述的方法,其特征在于,pi,j=mod(vi,j,z),其中vi,j的值以及該非零元素所在的行號(hào)和列號(hào)如下所示,所述基矩陣的所有其他元素是零元素:

3.根據(jù)權(quán)利要求1或2所述的方法:還包括:確定擴(kuò)展因子z,并根據(jù)擴(kuò)展因子z的組索引確定所述基矩陣。

4.根據(jù)權(quán)利要求1至3任意一項(xiàng)所述的方法,其特征在于,所述z的取值為{5,10,20,40,80,160,320}中的一個(gè)。

5.根據(jù)權(quán)利要求1至4任意一項(xiàng)所述的方法,其特征在于,所述擴(kuò)展因子z為滿足kb·z≥k的最小值,其中k為所述待編碼的輸入序列的長(zhǎng)度,kb為{6,8,9,10}中的一個(gè)。

6.根據(jù)權(quán)利要求5所述的方法,其特征在于,kb滿足:

7.根據(jù)權(quán)利要求1至6任意一項(xiàng)所述的方法,其特征在于,所述待編碼的輸入序列表示為c,編碼后的序列表示為d,其滿足:

8.根據(jù)權(quán)利要求7所述的方法,還包括:生成校驗(yàn)序列w,所述校驗(yàn)序列w包括n+2z-k個(gè)校驗(yàn)比特,n為編碼后的序列d的長(zhǎng)度,所述校驗(yàn)序列w表示為w0,w1,w2,…,wn+2z-k-1。

9.根據(jù)權(quán)利要求8所述的方法,其特征在于:所述ldpc矩陣表示為h,其中所述ldpc矩陣h,校驗(yàn)序列w和待編碼的輸入序列c滿足:其中c=[c0,c1,c2,...,ck-1]t,w=[w0,w1,w2,…,wn+2z-k-1]t,0表示列向量,其中所有元素的值為0。

10.根據(jù)權(quán)利要求9所述的方法,其特征在于,編碼后的序列d與所述校驗(yàn)序列w滿足:

11.根據(jù)權(quán)利要求1至10任一項(xiàng)所述的方法,其特征在于,

12.一種用于通信系統(tǒng)中的方法,包括:

13.根據(jù)權(quán)利要求12所述的方法,其特征在于,在擴(kuò)展因子z的值為{5,10,20,40,80,160,320}中的一個(gè)情況下,基于以下vi,j確定所述ldpc矩陣的至少一部分,其中i表示行號(hào),j表示列號(hào):

14.根據(jù)權(quán)利要求12或13所述的方法,其特征在于,所述ldpc矩陣是通過(guò)以下方式將基圖的每個(gè)元素替換為z*z的矩陣得到,其中基圖中的每個(gè)vi,j對(duì)應(yīng)的元素(i,j)被z*z大小的循環(huán)置換矩陣替換,基圖中的所有其他元素被z*z大小的全零矩陣替換。

15.根據(jù)權(quán)利要求14所述的方法,其特征在于,所述元素(i,j)對(duì)應(yīng)的循環(huán)置換矩陣是通過(guò)將z*z的單位矩陣進(jìn)行pi,j次向右或者向左循環(huán)移位得到,其中pi,j=mod(vi,j,z)。

16.根據(jù)權(quán)利要求12至15任一項(xiàng)所述的方法,其特征在于所述ldpc矩陣包括m行n列,其中7≤m≤42,17≤n≤52。

17.一種通信裝置,包括處理器以及與所述處理器耦合的存儲(chǔ)器,所述處理器用于執(zhí)行如權(quán)利要求1至16項(xiàng)任一項(xiàng)所述的方法。

18.根據(jù)權(quán)利要求17所述的通信裝置,其特征在于,所述存儲(chǔ)器用于保存以下一項(xiàng)或多項(xiàng):

19.根據(jù)權(quán)利要求18所述的通信裝置,其特征在于,所述與基矩陣相關(guān)的參數(shù)包括以下一項(xiàng)或多項(xiàng):所述基矩陣中代表循環(huán)置換矩陣的元素的位置,或所述基矩陣中代表循環(huán)置換矩陣的元素的vi,j值,或者所述基矩陣中每一行代表循環(huán)置換矩陣的元素的行重,或者所述基矩陣中每一列代表循環(huán)置換矩陣的元素的列重,或者,碼率。

20.根據(jù)權(quán)利要求17至19任一項(xiàng)所述的通信裝置,其特征在于,所述處理器還用于對(duì)編碼后的序列進(jìn)行速率匹配,交織,或調(diào)制。

21.根據(jù)權(quán)利要求17至20任一項(xiàng)所述的通信裝置,其特征在于,所述處理器還用于接收信號(hào),并對(duì)接收信號(hào)進(jìn)行以下一項(xiàng)或多項(xiàng)操作:解調(diào),解交織,解速率匹配,碼塊級(jí)聯(lián)、循環(huán)冗余校驗(yàn)。

22.一種計(jì)算機(jī)可讀存儲(chǔ)介質(zhì),包括指令,當(dāng)其在計(jì)算機(jī)上運(yùn)行時(shí),使得計(jì)算機(jī)執(zhí)行如權(quán)利要求1至16項(xiàng)任一項(xiàng)所述的方法。

23.一種計(jì)算機(jī)程序產(chǎn)品,使得計(jì)算機(jī)執(zhí)行如權(quán)利要求1至16項(xiàng)任一項(xiàng)所述的方法。


技術(shù)總結(jié)
本申請(qǐng)公開(kāi)了編碼方法,裝置、通信設(shè)備和通信系統(tǒng)。通過(guò)使用低密度奇偶校驗(yàn)LDPC矩陣對(duì)輸入比特序列進(jìn)行編碼以獲得用于傳輸?shù)木幋a比特序列。其中,所述LDPC矩陣是基于擴(kuò)展因子Z和基矩陣獲得的。本申請(qǐng)還公開(kāi)了基矩陣的多種不同結(jié)構(gòu)的設(shè)計(jì)。本申請(qǐng)的編碼方法、裝置、通信設(shè)備和通信系統(tǒng),能夠支持多種長(zhǎng)度的信息比特序列的編碼需求。

技術(shù)研發(fā)人員:金杰,馬祖連科依萬(wàn)·列昂尼多維奇,亞歷山大·亞歷山大羅維奇·帕特尤斯基,張朝龍
受保護(hù)的技術(shù)使用者:華為技術(shù)有限公司
技術(shù)研發(fā)日:
技術(shù)公布日:2025/1/2
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